R4000: Difference between revisions

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[[File:KL Toshiba MIPS R4000.jpg|thumb|एक तोशिबा R4000 माइक्रोप्रोसेसर]]
[[File:KL Toshiba MIPS R4000.jpg|thumb|तोशिबा आर4000 माइक्रोप्रोसेसर]]
[[File:MIPS R4000 die.JPG|thumb|MIPS R4000 [[ मरो शॉट ]]]]आर4000 एक [[माइक्रोप्रोसेसर]] है जिसे [[MIPS Technologies|एमआईपीएस संगणक प्रणाली]] के द्वारा विकसित किया गया है, जो [[MIPS III|एमआईपीएस III]] [[ निर्देश सेट वास्तुकला |इंस्ट्रक्शन सेट आर्किटेक्चर]] (आईएसए) को लागू करता है। इसे 1 अक्टूबर 1991 को आधिकारिक रूप से घोषित किया गया था, यह पहले 64-बिट माइक्रोप्रोसेसरों में से एक था और पहला एमआईपीएस III कार्यान्वयन में से एक था। जब [[RISC|आरआईएससी]] माइक्रोप्रोसेसरों की अपेक्षा की जा रही थी कि वे इंटेल [[i486]] जैसे CISC माइक्रोप्रोसेसरों को परिवर्तित कर दिया जायेगा, तब [[उन्नत कंप्यूटिंग वातावरण|विकसित संगणना परिसर]] (एडवांस्ड कंप्यूटिंग एनवायरनमेंट, एसीई) का माइक्रोप्रोसेसर बनाने के लिए आर4000 का चयन किया गया। एसीई अंततः कई कारणों से असफल रहा, लेकिन आर4000 को कार्यस्थल और सर्वर मार्केट में सफलता प्राप्त हुई।
[[File:MIPS R4000 die.JPG|thumb|एमआईपीएस आर4000 [[ मरो शॉट |डाई शॉट]] ]]'''आर4000''' एक [[माइक्रोप्रोसेसर]] है जिसे [[MIPS Technologies|एमआईपीएस संगणक प्रणाली]] के द्वारा विकसित किया गया है, जो [[MIPS III|एमआईपीएस III]] [[ निर्देश सेट वास्तुकला |इंस्ट्रक्शन सेट आर्किटेक्चर]] (आईएसए) को लागू करता है। इसे 1 अक्टूबर 1991 को आधिकारिक रूप से घोषित किया गया था, यह पहले 64-बिट माइक्रोप्रोसेसरों में से एक था और पहला एमआईपीएस III कार्यान्वयन में से एक था। जब [[RISC|आरआईएससी]] माइक्रोप्रोसेसरों की अपेक्षा की जा रही थी कि वे इंटेल [[i486|आई486]] जैसे सीआईएससी माइक्रोप्रोसेसरों को परिवर्तित कर दिया जायेगा, तब [[उन्नत कंप्यूटिंग वातावरण|विकसित संगणना परिसर]] (एडवांस्ड कंप्यूटिंग एनवायरनमेंट, एसीई) का माइक्रोप्रोसेसर बनाने के लिए आर4000 का चयन किया गया। एसीई अंततः कई कारणों से असफल रहा, लेकिन आर4000 को कार्यस्थल और सर्वर मार्केट में सफलता प्राप्त हुई।


== मॉडल ==
== मॉडल ==
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=== पूर्णांक निष्पादन ===
=== पूर्णांक निष्पादन ===
R4000 में एक [[अंकगणितीय तर्क इकाई]] (ALU), एक शिफ्टर, गुणक और विभाजक और पूर्णांक निर्देशों को निष्पादित करने के लिए लोड संरेखक है। ALU में 64-बिट [[कैरी-सेलेक्ट ऐडर]] और एक लॉजिक यूनिट होता है और यह पाइपलाइन में होता है। शिफ्टर 32-बिट [[बैरल शिफ्टर]] है। यह दो चक्रों में 64-बिट बदलाव करता है, जिसके परिणामस्वरूप पाइपलाइन रुक जाती है। डाई एरिया को बचाने के लिए इस डिजाइन को चुना गया था। मल्टीप्लायर और डिवाइडर को पाइपलाइन नहीं किया जाता है और महत्वपूर्ण लेटेंसी होती है: मल्टीप्लायर में क्रमशः 32-बिट या 64-बिट पूर्णांक के लिए 10- या 20-साइकिल लेटेंसी होती है; जबकि विभाजन में क्रमशः 32-बिट या 64-बिट पूर्णांकों के लिए 69- या 133-चक्र विलंबता होती है। अधिकांश निर्देशों में एक एकल चक्र विलंबता होती है। लोड, स्टोर और शाखाओं के लिए आभासी पतों की गणना के लिए ALU योजक का भी उपयोग किया जाता है।
आर4000 में पूर्णांक निर्देशों को निष्पादित करने के लिए [[अंकगणितीय तर्क इकाई|अर्थमैटिक लॉजिक यूनिट]] (एएलयु), एक शिफ्टर, गुणक (मल्टीप्लायर) और विभाजक (डिवाइडर) और लोड एलाईनर होता है। एएलयु में 64-बिट [[कैरी-सेलेक्ट ऐडर]] और लॉजिक यूनिट होती है और यह पाइपलाइन होती है। शिफ्टर 32-बिट [[बैरल शिफ्टर]] होता है। यह दो चक्रों में 64-बिट शिफ्ट करता है, जिसके परिणामस्वरूप पाइपलाइन में  विलम्बन होता है। यह डिज़ाइन डाई रीजन सेव करने के लिए चयनित किया गया था। गुणक और विभाजक पाइपलाइन नहीं होती हैं और सार्थक विलंबता (लटेंसी) होती है: गुणन के लिए 32-बिट या 64-बिट पूर्णांकों के लिए 10 या 20 चक्रों की विलंबता होती है, जबकि विभाजन के लिए 32-बिट या 64-बिट पूर्णांकों के लिए 69 या 133 चक्रों की लटेंसी होती है। अधिकांश निर्देशों की एक चक्र विलंबता होती है। एएलयु ऐडर का उपयोग भी लोड, स्टोर और शाखाओं के लिए आभासी एड्रेस की गणना करने के लिए किया जाता है।


लोड और स्टोर निर्देश पूर्णांक पाइपलाइन द्वारा निष्पादित किए जाते हैं, और ऑन-चिप 8 KB डेटा कैश तक पहुंच प्राप्त करते हैं।
लोड और स्टोर निर्देश पूर्णांक पाइपलाइन द्वारा निष्पादित किए जाते हैं, और ऑन-चिप 8 KB डेटा कैश प्राप्त करते हैं।


=== फ़्लोटिंग-पॉइंट निष्पादन ===
=== फ़्लोटिंग-पॉइंट निष्पादन ===
R4000 में ऑन-डाई [[IEEE 754-1985]]-संगत [[फ्लोटिंग-पॉइंट यूनिट]] (FPU) है, जिसे R4010 कहा जाता है। FPU एक सहसंसाधक नामित CP1 है<ref>''MIPS R4000 Microprocessor User's Manual, Second Edition'', p.&nbsp;152</ref> (MIPS ISA ने चार सहसंसाधकों को परिभाषित किया, CP0 से CP3 नामित)। FPU दो मोड में काम कर सकता है, 32- या 64-बिट जो CPU स्थिति रजिस्टर में बिट, FR बिट सेट करके चुने जाते हैं। 32-बिट मोड में, 32 फ्लोटिंग-पॉइंट रजिस्टर 32 बिट चौड़े हो जाते हैं, जब सिंगल-प्रिसिजन फ्लोटिंग-पॉइंट नंबरों को होल्ड किया जाता है। जब डबल-सटीक संख्या रखने के लिए उपयोग किया जाता है, तो 16 फ़्लोटिंग-पॉइंट रजिस्टर होते हैं (रजिस्टर जोड़े जाते हैं)।
आर4000 में ऑन-डाई [[IEEE 754-1985|आईईईई 754-1985]]-संगत [[फ्लोटिंग-पॉइंट यूनिट]] (एफपीयु) होता है, जिसे आर4010 के नाम से जाना जाता है। एफपीयु एक प्रकार का कोप्रोसेसर होता है और सीपी1<ref>''MIPS R4000 Microprocessor User's Manual, Second Edition'', p.&nbsp;152</ref> के रूप में निर्दिष्ट किया गया है (एमआईपीएस आईएसए ने सीपी0 से सीपी3 तक चार कोप्रोसेसरों को परिभाषित किया है)। एफपीयु दो मोड में कार्य कर सकता है, 32-या 64-बिट, जो सीपीयु स्टेट्स रजिस्टर में बिट, एफआर बिट सेट करके चयनित किए जाते हैं। 32-बिट मोड में, 32 फ्लोटिंग-पॉइंट रजिस्टर एकल-प्रिसिजन फ्लोटिंग-पॉइंट संख्याओं को धारण करने के लिए 32 बिट वाइड हो जाते हैं। डबल-प्रिसिजन संख्याओं को धारण करने के लिए, 16 फ्लोटिंग-पॉइंट रजिस्टर होते हैं (रजिस्टरों को युग्मित किया जाता है)।


एफपीयू एएलयू के समानांतर काम कर सकता है जब तक कि कोई डेटा या संसाधन निर्भरता न हो, जिसके कारण यह रुक जाता है। इसमें तीन उप-इकाइयां होती हैं: एक योजक, एक गुणक और एक विभाजक। गुणक और विभाजक योजक के साथ समानांतर में एक निर्देश को निष्पादित कर सकते हैं, लेकिन वे निष्पादन के अपने अंतिम चरण में योजक का उपयोग करते हैं, इस प्रकार ओवरलैपिंग निष्पादन की सीमाएं लगाते हैं। इस प्रकार, कुछ शर्तों के तहत, यह किसी भी समय तीन निर्देशों को निष्पादित कर सकता है, प्रत्येक इकाई में एक। एफपीयू प्रति चक्र एक निर्देश सेवानिवृत्त करने में सक्षम है।
एफपीयू एएलयू के साथ समानांतर में कार्य कर सकता है, जब तक कि डेटा या संसाधन आपेक्षिकता होने के कारण यह अवरुद्ध होता है। इसमें तीन उप-यूनिट होती हैं: एक योजक (ऐडर), एक गुणक और एक विभाजक। गुणक और विभाजक योजक के साथ समानांतर में एक निर्देश को क्रियान्वित कर सकते हैं, लेकिन वे अपने कार्य के अंतिम चरण में योजक का उपयोग करते हैं, इस प्रकार ओवरलैपिंग निष्पादन पर सीमाएं लगाते हैं। इस प्रकार, निश्चित शर्तों के अंतर्गत, यह किसी भी समय तीन निर्देशों को क्रियान्वित कर सकता है, प्रत्येक यूनिट में एक। एफपीयू प्रति चक्र एक निर्देश को सेवानिवृत्त करने में सक्षम होता है।


योजक और गुणक पाइपलाइन में हैं। मल्टीप्लायर में चार चरणों वाली मल्टीप्लायर पाइपलाइन होती है। यह पर्याप्त प्रदर्शन के लिए माइक्रोप्रोसेसर की क्लॉक फ्रीक्वेंसी से दुगुनी घड़ी पर क्लॉक किया जाता है और हाई क्लॉक फ्रीक्वेंसी प्राप्त करने के लिए डायनेमिक लॉजिक (डिजिटल इलेक्ट्रॉनिक्स) का उपयोग करता है। डिवीजन में सिंगल- या डबल-प्रिसिजन ऑपरेशंस के लिए 23- या 36-चक्र विलंबता है और स्क्वायर-रूट में 54- या 112-चक्र विलंबता है। डिवीजन और स्क्वायर-रूट डिवीजन एल्गोरिदम#SRT डिवीजन एल्गोरिदम का उपयोग करता है।
योजक और गुणक को पाइपलाइन किया गया है। गुणक में चार चरण वाली गुणक पाइपलाइन होती है। पर्याप्त कार्यव्यान के लिए इसे माइक्रोप्रोसेसर की क्लॉक आवृत्ति से दोगुनी गति पर क्लॉक किया जाता है और उच्च क्लॉक आवृत्ति प्राप्त करने के लिए डायनामिक लॉजिक का उपयोग किया जाता है। विभाजन में एकल या डबल-प्रिसिजन संचालन के लिए 23- या 36-चक्र विलंबता होती है और वर्ग-रूट में 54- या 112-चक्र विलंबता होती है। विभाजन और वर्गमूल एसआरटी एल्गोरिदम का उपयोग करता है।


=== स्मृति प्रबंधन ===
=== मेमोरी मैनेजमेंट ===
वर्चुअल पतों का अनुवाद करने के लिए [[ स्मृति प्रबंधन इकाई ]] (MMU) 48-एंट्री ट्रांसलेशन लुकसाइड बफर का उपयोग करता है। R4000 64-बिट [[ आभासी पता ]] का उपयोग करता है, लेकिन 64 बिट्स में से केवल 40 को लागू करता है, जिससे 1 टीबी [[ आभासी मेमोरी ]] की अनुमति मिलती है; शेष बिट्स की जाँच यह सुनिश्चित करने के लिए की जाती है कि उनमें शून्य है। R4000 36-बिट भौतिक पते का उपयोग करता है, इस प्रकार 64 GB भौतिक मेमोरी को संबोधित करने में सक्षम है।
[[ स्मृति प्रबंधन इकाई |मेमोरी मैनेजमेंट यूनिट]] (एमएमयू) आभासी एड्रेस का अनुवाद करने के लिए 48-एंट्री ट्रांसलेशन लुकसाइड बफर का उपयोग करता है। आर4000 64-बिट [[ आभासी पता |आभासी एड्रेस]] का उपयोग करता है, लेकिन 64 बिट्स में से केवल 40 बिट्स को लागू करता है, 1 TB [[ आभासी मेमोरी |आभासी मेमोरी]] की अनुमति देता है; यह सुनिश्चित करने के लिए शेष बिट्स की जाँच की जाती है कि उनमें शून्य है। आर4000 36-बिट फिजिकल एड्रेस का उपयोग करता है, इस प्रकार 64 GB की फिज़िकल मेमोरी को संबोधित करने में सक्षम होता है।


=== माध्यमिक कैश ===
=== द्वितीयक कैश ===
R4000 (SC और MC कॉन्फ़िगरेशन केवल) 128 KB से 4 MB की क्षमता वाले बाहरी द्वितीयक कैश का समर्थन करता है। कैश को समर्पित 128-बिट डेटा बस के माध्यम से एक्सेस किया जाता है। द्वितीयक कैश को एकीकृत कैश के रूप में या विभाजित निर्देश और डेटा कैश के रूप में कॉन्फ़िगर किया जा सकता है। बाद वाले कॉन्फ़िगरेशन में, प्रत्येक कैश की क्षमता 128 केबी से 2 एमबी तक हो सकती है।<ref>Heinrich, "MIPS R4000 Microprocessor User's Manual", p.&nbsp;248</ref> सेकेंडरी कैश CPU cache#Address translation|भौतिक रूप से अनुक्रमित, भौतिक रूप से टैग किया गया है और इसमें 128, 256, 512 या 1,024 बाइट्स का प्रोग्राम करने योग्य लाइन आकार है। कैश कंट्रोलर ऑन-डाई है। कैश मानक [[स्थिर रैंडम एक्सेस मेमोरी]] (SRAM) से बनाया गया है। डेटा और टैग बसें ईसीसी-संरक्षित हैं।
आर4000 (केवल एससी और एमसी कॉन्फ़िगरेशन) 128 केबी से 4 एमबी की क्षमता वाले बाहरी माध्यमिक कैश का समर्थन करता है। कैश एक निर्धारित 128-बिट डेटा बस के माध्यम से उपलब्ध होता है। द्वितीयक कैश को एकीकृत कैश के रूप में या विभाजित अनुदेश और डेटा कैश के रूप में कॉन्फ़िगर किया जा सकता है। उत्तरार्द्ध कॉन्फ़िगरेशन में, प्रत्येक कैश में 128 KB से 2 MB की क्षमता हो सकती है।<ref>Heinrich, "MIPS R4000 Microprocessor User's Manual", p.&nbsp;248</ref> द्वितीयक कैश को भौतिक रूप से अनुक्रमित किया जाता है, भौतिक रूप से टैग किया जाता है और इसमें 128, 256, 512 या 1,024 बाइट्स का प्रोग्राम लाइन आकार होता है। कैश कंट्रोलर ऑन-डाई होता है। कैशे स्टैण्डर्ड [[स्थिर रैंडम एक्सेस मेमोरी|स्टैटिक रैंडम एक्सेस मेमोरी]] (एसआरएएम) से बनाया गया है। डेटा और टैग बसों को ईसीसी-संरक्षित किया जाता है।


=== सिस्टम बस ===
=== सिस्टम बस ===
R4000 64-बिट सिस्टम बस का उपयोग करता है जिसे SysAD बस कहा जाता है। SysAD बस एक एड्रेस और डेटा मल्टीप्लेक्स बस थी, यानी यह डेटा और एड्रेस ट्रांसफर करने के लिए तारों के एक ही सेट का इस्तेमाल करती थी। जबकि यह बैंडविड्थ को कम करता है, यह एक अलग एड्रेस बस प्रदान करने की तुलना में कम खर्चीला भी है, जिसके लिए अधिक पिन की आवश्यकता होती है और सिस्टम की जटिलता बढ़ जाती है। SysAD बस को आंतरिक घड़ी आवृत्ति के आधे, एक तिहाई या एक चौथाई पर संचालित करने के लिए कॉन्फ़िगर किया जा सकता है। SysAD बस ऑपरेटिंग फ्रीक्वेंसी को विभाजित करके अपना क्लॉक सिग्नल उत्पन्न करती है।
आर4000 में SysAD बस के रूप में 64-बिट सिस्टम बस का उपयोग होता है। SysAD बस एक एड्रेस और डेटा मल्टीप्लेक्स्ड बस है, अर्थात यह डेटा और एड्रेस को स्थानांतरित करने के लिए एक ही वायर सेट का उपयोग करता है। हालाँकि यह बैंडविड्थ कम करता है, लेकिन सिस्टम की जटिलता को बढ़ाने वाले एड्रेस बस की तुलना में कम लागतग्रस्त होता है, जिसमें अधिक पिन की आवश्यकता होती है। SysAD बस को आंतरिक क्लॉक फ्रिक्वेंसी का आधा, तिहाई या चौथाई रूप में कार्यान्वित करने के लिए कॉन्फ़िगर किया जा सकता है। SysAD बस अपने क्लॉक सिग्नल को आपरेटिंग आवृत्ति से विभाजित करके उत्पन्न करता है।
 
=== ट्रांजिस्टर की संख्या, डाइ डायमेंशन और प्रक्रिया विवरण ===
R4000 में 1.2 मिलियन ट्रांजिस्टर हैं।<ref name="IEEE Micro P:10">[[#IEEE Micro|Mirapuri, "The Mips R4000 Processor"]], p.&nbsp;10</ref> इसे 1.0 माइक्रोन दो-परत धातु सीएमओएस | पूरक धातु-ऑक्साइड-सेमीकंडक्टर (सीएमओएस) प्रक्रिया के लिए डिज़ाइन किया गया था। चूंकि MIPS एक काल्पनिक कंपनी थी, इसलिए R4000 को साझेदारों ने अपनी प्रक्रियाओं में बनाया था, जिसमें 0.8 μm न्यूनतम फीचर आकार था।<ref name="IEEE Micro P:21">[[#IEEE Micro|Mirapuri, "The Mips R4000 Processor"]], p.&nbsp;21</ref>
 


=== ट्रांजिस्टर काउंट, डाई डायमेंशन्स और प्रक्रिया विवरण ===
आर4000 में 1.2 मिलियन ट्रांजिस्टर होता हैं।<ref name="IEEE Micro P:10">[[#IEEE Micro|Mirapuri, "The Mips R4000 Processor"]], p.&nbsp;10</ref> इसे 1.0 μm दो-परत धातु पूरक धातु-ऑक्साइड-अर्धचालक (सीएमओएस) प्रक्रिया के लिए डिज़ाइन किया गया था। चूँकि एमआईपीएस एक फ़ेबलेस कंपनी थी, आर4000 को सहभागियों द्वारा अपनी प्रक्रियाओं में निर्मित किया गया था, जिसका न्यूनतम फीचर साइज 0.8 μm था।<ref name="IEEE Micro P:21">[[#IEEE Micro|Mirapuri, "The Mips R4000 Processor"]], p.&nbsp;21</ref>
=== क्लॉकिंग ===
=== क्लॉकिंग ===
R4000 बाहरी रूप से उत्पन्न मास्टर क्लॉक सिग्नल से विभिन्न क्लॉक सिग्नल उत्पन्न करता है। ऑपरेटिंग फ्रीक्वेंसी के लिए, R4000 ऑन-डाई [[ चरण बंद लूप ]] (PLL) के उपयोग से मास्टर क्लॉक सिग्नल को दो से गुणा करता है।
आर4000 बाह्‍यतः उत्पन्न एक मास्टर क्लॉक सिग्नल से विभिन्न क्लॉक सिग्नल उत्पन्न करता है। ऑपरेटिंग फ़्रीक्वेंसी के लिए, आर4000 ऑन-डाई फेज़-लॉक लूप (पीएलएल) के उपयोग से मास्टर क्लॉक सिग्नल को दो से गुणा करता है।


=== पैकेजिंग ===
=== पैकेजिंग ===
R4000PC को 179-पिन सिरेमिक [[पिन ग्रिड सरणी]] (CPGA) में पैक किया गया है। R4000SC और R4000MC को 447-पिन सिरेमिक [[कंपित पिन ग्रिड ऐरे]] (SPGA) में पैक किया गया है। R4000MC का पिन R4000SC से अलग है, कुछ पिन जो R4000SC पर अप्रयुक्त हैं, R4000MC पर [[कैश सुसंगतता]] को लागू करने के लिए संकेतों के लिए उपयोग किया जाता है। R4000PC का पिन-आउट PGA-संकुलित [[R4200]] और [[R4600]] माइक्रोप्रोसेसरों के समान है। यह विशेषता तीन माइक्रोप्रोसेसरों में से किसी एक का उपयोग करने के लिए ठीक से डिज़ाइन की गई प्रणाली को सक्षम बनाती है।
आर4000पीसी को 179-पिन सिरेमिक [[पिन ग्रिड सरणी|पिन ग्रिड ऐरे]] (सीपीजीए) में पैकेज किया जाता है। आर4000एससी और आर4000एमसी को 447-पिन सिरेमिक [[कंपित पिन ग्रिड ऐरे|स्टैगर्ड पिन ग्रिड ऐरे]] (एसपीजीए) में पैकेज किया जाता है। आर4000एमसी का पिन आउट आर4000एससी से भिन्न होता है, जहां आर4000एससी पर अप्रयोगित कुछ पिन आर4000एमसी पर [[कैश सुसंगतता|कैश समन्वय]] को कार्यान्वित करने के लिए सिग्नल के लिए उपयोग किए जाते हैं। आर4000पीसी का पिन आउट पीजीए-पैकेज [[R4200|आर4200]] और [[R4600|आर4600]] माइक्रोप्रोसेसर के समान होता है। यह विशेषता एक योग्य डिज़ाइन किए गए सिस्टम को किसी भी तीन माइक्रोप्रोसेसर का उपयोग करने की संभावना प्रदान करती है।


== R4400 ==
== आर4400 ==
[[File:Toshiba TC86R4400MC-200 9636YJA top.jpg|thumb|तोशिबा द्वारा निर्मित R4400MC माइक्रोप्रोसेसर का एक उदाहरण]]
[[File:Toshiba TC86R4400MC-200 9636YJA top.jpg|thumb|तोशिबा द्वारा निर्मित आर4400एमसी माइक्रोप्रोसेसर का एक उदाहरण]]
[[File:NEC VR4400 die.JPG|thumb|NEC VR4400MC डाई शॉट]]R4400, R4000 का एक और विकास है। नवंबर 1992 की शुरुआत में इसकी घोषणा की गई थी। जनवरी 1993 में सामान्य उपलब्धता के साथ माइक्रोप्रोसेसर के नमूने इससे पहले चयनित ग्राहकों को भेज दिए गए थे। R4400 100, 133, 150, 200 और 250 मेगाहर्ट्ज की घड़ी की आवृत्ति पर काम करता है। R4000 से एकमात्र बड़ा सुधार बड़ा प्राथमिक कैश है, जो प्रत्येक 8 KB से 16 KB की क्षमता में दोगुना हो गया था। इसमें 2.3 मिलियन ट्रांजिस्टर थे।
[[File:NEC VR4400 die.JPG|thumb|एनईसी वीआर4400एमसी डाई शॉट]]'''आर4400''', आर4000 का अग्रिम के अन्य विकास का उदाहरण है। इसे नवंबर 1992 के पहले सप्ताह में घोषित किया गया था। माइक्रोप्रोसेसर के प्रतिदर्श जनवरी 1993 में सामान्य उपलब्धता के साथ चयनित ग्राहकों को भेज दिए गए थे। आर4400 की क्लॉक आवृत्तियाँ 100, 133, 150, 200 और 250 MHz होती हैं। R4000 से केवल मुख्य कैश में बड़ा संशोधन होता है, जिनकी क्षमता 8 KB से प्रत्येक 16 KB तक दोगुनी कर दी गई। इसमें 2.3 मिलियन ट्रांजिस्टर्स होते हैं।


R4400 को [[ एकीकृत उपकरण प्रौद्योगिकी ]] (IDT), LSI लॉजिक, NEC, परफॉर्मेंस सेमीकंडक्टर, [[Siemens AG]] और Toshiba द्वारा लाइसेंस दिया गया था। आईडीटी, [[एनईसी]], सीमेंस और [[ तोशीबा ]] ने माइक्रोप्रोसेसर का निर्माण और विपणन किया। LSI लॉजिक ने कस्टम उत्पादों में R4400 का उपयोग किया। प्रदर्शन सेमीकंडक्टर ने अपने लॉजिक डिवीजन को [[सरू सेमीकंडक्टर]] को बेच दिया जहां एमआईपीएस माइक्रोप्रोसेसर उत्पादों को बंद कर दिया गया था।
आर4400 को [[ एकीकृत उपकरण प्रौद्योगिकी |इंटीग्रेटेड डिवाइस टेक्नोलॉजी]] (आईडीटी), एलएसआई लॉजिक, [[एनईसी]], परफॉर्मेंस सेमीकंडक्टर, [[Siemens AG|सीमेंस एजी]] और [[ तोशीबा |तोशीबा]] द्वारा लाइसेंस प्राप्त था। आईडीटी, एनईसी, सीमेंस और तोशिबा ने माइक्रोप्रोसेसर का निर्माण और विपणन किया। एलएसआई लॉजिक ने कस्टम उत्पादों में आर4400 का उपयोग किया। परफॉर्मेंस अर्धचालक ने अपना लॉजिक डिवीजन [[सरू सेमीकंडक्टर|साइप्रस अर्धचालक]] को बेच दिया जहां एमआईपीएस माइक्रोप्रोसेसर उत्पादों को संवृत कर दिया गया।


NEC ने VR4400 के रूप में अपने संस्करण का विपणन किया। पहला संस्करण, एक 150 मेगाहर्ट्ज भाग, नवंबर 1992 में घोषित किया गया था। प्रारंभिक संस्करण 0.6 μm प्रक्रिया में निर्मित किए गए थे।<ref>"NEC VR4400 Clock-Doubling RISC Has 2m Transistors"</ref> 1995 के मध्य में, 250 मेगाहर्ट्ज वाले हिस्से का नमूना लेना शुरू किया गया। इसे 0.35 माइक्रोन चार-परत-धातु प्रक्रिया में बनाया गया था।<ref>"NEC Ready With 250MHz Version Of The 64-Bit MIPS R4400 RISC"</ref> NEC ने MR4401, एक सिरेमिक [[मल्टी-चिप मॉड्यूल]] (MCM) का भी उत्पादन किया जिसमें दस 1 Mbit SRAM चिप्स के साथ VR4400SC शामिल था जिसने 1 MB द्वितीयक कैश को लागू किया। MCM R4x00PC के साथ पिन-संगत था। पहला संस्करण, एक 150 मेगाहर्ट्ज भाग, 1994 में घोषित किया गया था। 1995 में, एक 200 मेगाहर्ट्ज भाग की घोषणा की गई थी।
एनईसी ने अपने संस्करण को वीआर4400 के रूप में विपणन किया। प्रथम संस्करण, 150 MHz भाग, नवंबर 1992 में घोषित किया गया था। प्रारंभिक संस्करण 0.6 μm प्रक्रिया में निर्मित किए गए थे।<ref>"NEC VR4400 Clock-Doubling RISC Has 2m Transistors"</ref> 1995 के मध्य में, 250 MHz भाग का प्रतिदर्श लेना शुरू किया गया। इसे 0.35 μm चार-परत-धातु प्रक्रिया में निर्मित किया गया था।<ref>"NEC Ready With 250MHz Version Of The 64-Bit MIPS R4400 RISC"</ref> एनईसी ने एमआर4401, सिरेमिक [[मल्टी-चिप मॉड्यूल]] (एमसीएम) भी तैयार किया, जिसमें दस 1 Mbit एसआरएएम चिप्स के साथ वीआर4400एससी सम्मिलित था, जो 1 MB सेकेंडरी कैश को लागू करता था। एमसीएम आर4x00पीसी के साथ पिन-संगत था। प्रथम संस्करण, 150 MHz भाग की घोषणा 1994 में की गई थी। 1995 में, 200 MHz भाग की घोषणा की गई थी।


तोशिबा ने अपने संस्करण की मार्केटिंग TC86R4400 के रूप में की। एक 200 मेगाहर्ट्ज वाला हिस्सा जिसमें 2.3 मिलियन ट्रांजिस्टर हैं और जिसकी माप 134 मिमी है<sup>2</sup> 0.3 μm प्रक्रिया में निर्मित 1994 के मध्य में पेश किया गया था। R4400PC की कीमत थी {{US$|long=no|1600}}, R4400SC at {{US$|long=no|1950}}, और R4400MC पर {{US$|long=no|2150}} 10,000 की मात्रा में।<ref>"Toshiba Has 200MHz MIPS R4400"</ref>
तोशिबा ने अपना संस्करण टीसी86आर4400 के रूप में विपणन किया। 200 MHz भाग जिसमें 2.3 मिलियन ट्रांजिस्टर हैं और 0.3 μm प्रक्रिया में निर्मित 134 mm<sup>2</sup> माप है, 1994 के मध्य में प्रस्तुत किया गया था। 10,000 की मात्रा में आर4400पीसी की लागत $1,600, आर4400एससी की लागत $1,950, और आर4400एमसी की लागत $2,150 थी।<ref>"Toshiba Has 200MHz MIPS R4400"</ref>
=== उपयोग ===
आर4400 का उपयोग निम्न द्वारा किया जाता है:


 
* कैरेरा कंप्यूटर्स ने अपने [[Windows NT|विंडोज एनटी]] पर्सनल कंप्यूटर और वर्कस्टेशन में उपयोग किया।<ref>"...And From Carrera Computers"</ref>
=== उपयोग ===
* [[समवर्ती कंप्यूटर निगम|संयुक्त कंप्यूटर कॉर्पोरेशन]] अपने रीयल-टाइम मल्टीप्रोसेसर मैक्सियन सिस्टम में<ref>"Concurrent Multiprocessors Feature New Bus Architecture"</ref>
R4400 द्वारा प्रयोग किया जाता है:
* उनके विंडोज़ एनटी पर्सनल कंप्यूटर और [[डेस्कस्टेशन टाइन]] वर्कस्टेशन में [[डेस्कस्टेशन प्रौद्योगिकी]]<ref>"MIPS R-Based Windows NT Personal Computers From Deskstation..."</ref>
<!--Do not list the Nintendo 64 here, it used a VR4300, not a R4400-->
* [[डिजिटल उपकरण निगम|डिजिटल इक्विपमेंट कॉर्पोरेशन]] अपने [[DECstation|डीईसीस्टेशन]] 5000/260 वर्कस्टेशन और सर्वर में उपयोग किया।
* Carrera कंप्यूटर अपने [[Windows NT]] पर्सनल कंप्यूटर और वर्कस्टेशन में<ref>"...And From Carrera Computers"</ref>
* एनईसी कॉर्पोरेशन अपने [[एनईसी रिस्कस्टेशन|आरआईएससीस्टेशन]] वर्कस्टेशन, आरआईएससीसर्वर सर्वर और सेनजू-3 सुपरकंप्यूटर में<ref>"NEC Goes After The Business Market With Its Latest Line Of RISC UNIX Workstations"</ref>
* उनके रीयल-टाइम मल्टीप्रोसेसर मैक्सियन सिस्टम में [[समवर्ती कंप्यूटर निगम]]<ref>"Concurrent Multiprocessors Feature New Bus Architecture"</ref>
* अपने विंडोज एनटी वर्कस्टेशन और सर्वर में NeTPower
* [[डेस्कस्टेशन प्रौद्योगिकी]] उनके विंडोज एनटी पर्सनल कंप्यूटर और [[डेस्कस्टेशन टाइन]] वर्कस्टेशन में<ref>"MIPS R-Based Windows NT Personal Computers From Deskstation..."</ref>
* [[ पिरामिड प्रौद्योगिकी |पिरामिड प्रौद्योगिकी]] ने अपने नाइल सीरीज सर्वर में आर4400एमसी का उपयोग किया<ref>"Pyramid Technology Aims To Crash The Mainframe With Nile Series"</ref>
* [[डिजिटल उपकरण निगम]] उनके [[DECstation]] 5000/260 वर्कस्टेशन और सर्वर में
* [[Siemens Nixdorf Informationssysteme|सीमेंस निक्सडॉर्फ इंफॉर्मेशन सिस्टम]] (एसएनआई) अपने आरएम-सीरीज [[यूनिक्स]] सर्वर और एसआर2000 [[मेनफ़्रेम कंप्यूटर|मेनफ़्रेम]] में
* एनईसी अपने [[एनईसी रिस्कस्टेशन]] वर्कस्टेशन, आरआईएससी सर्वर सर्वर और सेनजू-3 सुपरकंप्यूटर में<ref>"NEC Goes After The Business Market With Its Latest Line Of RISC UNIX Workstations"</ref>
* उनके ओनेक्स, [[एसजीआई इंडिगो|इंडिगो]], इंडिगो2 और [[एसजीआई इंडी|इंडी]] वर्कस्टेशन में [[सिलिकॉन ग्राफिक्स]]; और उनके चैलेंज सर्वर में
* उनके विंडोज एनटी वर्कस्टेशन और सर्वर में नेटपॉवर
* [[टंडेम कंप्यूटर|टेंडेम कंप्यूटर्स]] अपने [[नॉनस्टॉप (सर्वर कंप्यूटर)|नॉनस्टॉप]] हिमालय फॉल्ट-टॉलरेंट सर्वर में उपयोग किया।
* [[ पिरामिड प्रौद्योगिकी ]] ने अपने नाइल सीरीज सर्वर में R4400MC का इस्तेमाल किया<ref>"Pyramid Technology Aims To Crash The Mainframe With Nile Series"</ref>
* [[Siemens Nixdorf Informationssysteme]] (SNI) उनके RM-श्रृंखला [[यूनिक्स]] सर्वर और SR2000 [[मेनफ़्रेम कंप्यूटर]] में
* उनके [[ एसजीआई गोमेद ]], [[एसजीआई इंडिगो]], एसजीआई इंडिगो² और चैलेंज एम, और [[एसजीआई इंडी]] वर्कस्टेशन में [[सिलिकॉन ग्राफिक्स]]; और उनके SGI चैलेंज सर्वर में
* [[टंडेम कंप्यूटर]] उनके [[नॉनस्टॉप (सर्वर कंप्यूटर)]] दोष-सहिष्णु सर्वर में


== चिपसेट ==
== चिपसेट ==
R4000 और R4400 माइक्रोप्रोसेसरों को कस्टम ASIC या व्यावसायिक रूप से उपलब्ध चिपसेट द्वारा सिस्टम से जोड़ा गया था। एसजीआई जैसे सिस्टम विक्रेताओं ने अपने सिस्टम के लिए अपने स्वयं के एएसआईसी विकसित किए। तोशिबा जैसी कंपनियों द्वारा अपने टाइगर शार्क चिपसेट के साथ वाणिज्यिक चिपसेट विकसित, निर्मित और विपणन किए गए थे, जो i486-संगत बस प्रदान करते थे।<ref>"Toshiba Samples 80486-Bus Chip Set For R-Series".</ref>
आर4000 और आर4400 माइक्रोप्रोसेसरों को कस्टम एएसआईसी या व्यावसायिक रूप से उपलब्ध चिपसेट द्वारा सिस्टम में इंटरफ़ेस किया गया था। एसजीआई जैसे सिस्टम विक्रेताओं ने अपने सिस्टम के लिए अपने स्वयं के एएसआईसी विकसित किए। तोशिबा जैसी कंपनियों द्वारा अपने टाइगर शार्क चिपसेट के साथ वाणिज्यिक चिपसेट विकसित, निर्मित और विपणन किए गए, जो आई486-संगत बस प्रदान करते थे।<ref>"Toshiba Samples 80486-Bus Chip Set For R-Series".</ref>
 
 
== टिप्पणियाँ ==
== टिप्पणियाँ ==
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Revision as of 21:35, 2 July 2023

तोशिबा आर4000 माइक्रोप्रोसेसर
एमआईपीएस आर4000 डाई शॉट

आर4000 एक माइक्रोप्रोसेसर है जिसे एमआईपीएस संगणक प्रणाली के द्वारा विकसित किया गया है, जो एमआईपीएस III इंस्ट्रक्शन सेट आर्किटेक्चर (आईएसए) को लागू करता है। इसे 1 अक्टूबर 1991 को आधिकारिक रूप से घोषित किया गया था, यह पहले 64-बिट माइक्रोप्रोसेसरों में से एक था और पहला एमआईपीएस III कार्यान्वयन में से एक था। जब आरआईएससी माइक्रोप्रोसेसरों की अपेक्षा की जा रही थी कि वे इंटेल आई486 जैसे सीआईएससी माइक्रोप्रोसेसरों को परिवर्तित कर दिया जायेगा, तब विकसित संगणना परिसर (एडवांस्ड कंप्यूटिंग एनवायरनमेंट, एसीई) का माइक्रोप्रोसेसर बनाने के लिए आर4000 का चयन किया गया। एसीई अंततः कई कारणों से असफल रहा, लेकिन आर4000 को कार्यस्थल और सर्वर मार्केट में सफलता प्राप्त हुई।

मॉडल

आर4000 के तीन संस्थिति (कॉन्फ़िगरेशन) होते हैं: आर4000पीसी, एक प्रारंभिक स्तर का मॉडल जिसमें द्वितीयक कैश के लिए कोई समर्थन नहीं होता है; आर4000एससी, एक मॉडल जिसमें द्वितीयक कैश होता है लेकिन मल्टीप्रोसेसर क्षमता नहीं होती है; और आर4000एमसी, एक मॉडल जिसमें द्वितीयक कैश होता है और मल्टीप्रोसेसर सिस्टमों द्वारा आवश्यक कैश संसक्तता प्रोटोकॉल के लिए समर्थन होता है।

विवरण

आर4000 स्केलर सुपरपाइपलाइन वाला माइक्रोप्रोसेसर है जिसमें आठ-चरण पूर्णांक पाइपलाइन होती है। प्रथम चरण (आईएफ) के दौरान, एक निर्देश के लिए एक आभासी एड्रेस उत्पन्न होता है और निर्देश ट्रांसलेशन लुकसाइड बफर (टीएलबी) एड्रेस का भौतिक एड्रेस पर ट्रांसलेशन आरम्भ करता है। दूसरे चरण (आईएस) में, ट्रांसलेशन पूर्ण हो जाता है और निर्देश आंतरिक 8 KB निर्देश कैश से प्राप्त किया गया है। निर्देश कैश को प्रत्यक्ष-मैप और आभासी इंडेक्स, फिजिकली टैग किया जाता है। इसकी लाइन का आकार 16- या 32-बाइट है। वास्तुकला की दृष्टि से इसे 32 KB तक बढ़ाया जा सकता है।

तीसरे चरण (आरएफ) के दौरान, निर्देश को डिकोड किया जाता है और रजिस्टर फ़ाइल पढ़ी जाती है। एमआईपीएस III दो रजिस्टर फाइलों को परिभाषित करता है, एक पूर्णांक इकाई के लिए और दूसरा फ्लोटिंग-पॉइंट के लिए। प्रत्येक रजिस्टर फ़ाइल 64 बिट्स विस्तृत (वाइड) है और इसमें 32 प्रविष्टियाँ हैं। पूर्णांक रजिस्टर फ़ाइल में दो रीड पोर्ट और एक राइट पोर्ट होता है, जबकि फ्लोटिंग-पॉइंट रजिस्टर फ़ाइल में दो रीड पोर्ट और दो राइट पोर्ट होते हैं। पूर्णांक और फ़्लोटिंग-पॉइंट निर्देशों दोनों के लिए निष्पादन चरण चार (ईएक्स) पर शुरू होता है; और चरण आठ (डब्ल्यूबी) में पूरा होने पर वापस रजिस्टर फ़ाइलों में लिखा जाता है। परिणामों को संभव होने पर बाइपास किया जा सकता है।

पूर्णांक निष्पादन

आर4000 में पूर्णांक निर्देशों को निष्पादित करने के लिए अर्थमैटिक लॉजिक यूनिट (एएलयु), एक शिफ्टर, गुणक (मल्टीप्लायर) और विभाजक (डिवाइडर) और लोड एलाईनर होता है। एएलयु में 64-बिट कैरी-सेलेक्ट ऐडर और लॉजिक यूनिट होती है और यह पाइपलाइन होती है। शिफ्टर 32-बिट बैरल शिफ्टर होता है। यह दो चक्रों में 64-बिट शिफ्ट करता है, जिसके परिणामस्वरूप पाइपलाइन में  विलम्बन होता है। यह डिज़ाइन डाई रीजन सेव करने के लिए चयनित किया गया था। गुणक और विभाजक पाइपलाइन नहीं होती हैं और सार्थक विलंबता (लटेंसी) होती है: गुणन के लिए 32-बिट या 64-बिट पूर्णांकों के लिए 10 या 20 चक्रों की विलंबता होती है, जबकि विभाजन के लिए 32-बिट या 64-बिट पूर्णांकों के लिए 69 या 133 चक्रों की लटेंसी होती है। अधिकांश निर्देशों की एक चक्र विलंबता होती है। एएलयु ऐडर का उपयोग भी लोड, स्टोर और शाखाओं के लिए आभासी एड्रेस की गणना करने के लिए किया जाता है।

लोड और स्टोर निर्देश पूर्णांक पाइपलाइन द्वारा निष्पादित किए जाते हैं, और ऑन-चिप 8 KB डेटा कैश प्राप्त करते हैं।

फ़्लोटिंग-पॉइंट निष्पादन

आर4000 में ऑन-डाई आईईईई 754-1985-संगत फ्लोटिंग-पॉइंट यूनिट (एफपीयु) होता है, जिसे आर4010 के नाम से जाना जाता है। एफपीयु एक प्रकार का कोप्रोसेसर होता है और सीपी1[1] के रूप में निर्दिष्ट किया गया है (एमआईपीएस आईएसए ने सीपी0 से सीपी3 तक चार कोप्रोसेसरों को परिभाषित किया है)। एफपीयु दो मोड में कार्य कर सकता है, 32-या 64-बिट, जो सीपीयु स्टेट्स रजिस्टर में बिट, एफआर बिट सेट करके चयनित किए जाते हैं। 32-बिट मोड में, 32 फ्लोटिंग-पॉइंट रजिस्टर एकल-प्रिसिजन फ्लोटिंग-पॉइंट संख्याओं को धारण करने के लिए 32 बिट वाइड हो जाते हैं। डबल-प्रिसिजन संख्याओं को धारण करने के लिए, 16 फ्लोटिंग-पॉइंट रजिस्टर होते हैं (रजिस्टरों को युग्मित किया जाता है)।

एफपीयू एएलयू के साथ समानांतर में कार्य कर सकता है, जब तक कि डेटा या संसाधन आपेक्षिकता होने के कारण यह अवरुद्ध होता है। इसमें तीन उप-यूनिट होती हैं: एक योजक (ऐडर), एक गुणक और एक विभाजक। गुणक और विभाजक योजक के साथ समानांतर में एक निर्देश को क्रियान्वित कर सकते हैं, लेकिन वे अपने कार्य के अंतिम चरण में योजक का उपयोग करते हैं, इस प्रकार ओवरलैपिंग निष्पादन पर सीमाएं लगाते हैं। इस प्रकार, निश्चित शर्तों के अंतर्गत, यह किसी भी समय तीन निर्देशों को क्रियान्वित कर सकता है, प्रत्येक यूनिट में एक। एफपीयू प्रति चक्र एक निर्देश को सेवानिवृत्त करने में सक्षम होता है।

योजक और गुणक को पाइपलाइन किया गया है। गुणक में चार चरण वाली गुणक पाइपलाइन होती है। पर्याप्त कार्यव्यान के लिए इसे माइक्रोप्रोसेसर की क्लॉक आवृत्ति से दोगुनी गति पर क्लॉक किया जाता है और उच्च क्लॉक आवृत्ति प्राप्त करने के लिए डायनामिक लॉजिक का उपयोग किया जाता है। विभाजन में एकल या डबल-प्रिसिजन संचालन के लिए 23- या 36-चक्र विलंबता होती है और वर्ग-रूट में 54- या 112-चक्र विलंबता होती है। विभाजन और वर्गमूल एसआरटी एल्गोरिदम का उपयोग करता है।

मेमोरी मैनेजमेंट

मेमोरी मैनेजमेंट यूनिट (एमएमयू) आभासी एड्रेस का अनुवाद करने के लिए 48-एंट्री ट्रांसलेशन लुकसाइड बफर का उपयोग करता है। आर4000 64-बिट आभासी एड्रेस का उपयोग करता है, लेकिन 64 बिट्स में से केवल 40 बिट्स को लागू करता है, 1 TB आभासी मेमोरी की अनुमति देता है; यह सुनिश्चित करने के लिए शेष बिट्स की जाँच की जाती है कि उनमें शून्य है। आर4000 36-बिट फिजिकल एड्रेस का उपयोग करता है, इस प्रकार 64 GB की फिज़िकल मेमोरी को संबोधित करने में सक्षम होता है।

द्वितीयक कैश

आर4000 (केवल एससी और एमसी कॉन्फ़िगरेशन) 128 केबी से 4 एमबी की क्षमता वाले बाहरी माध्यमिक कैश का समर्थन करता है। कैश एक निर्धारित 128-बिट डेटा बस के माध्यम से उपलब्ध होता है। द्वितीयक कैश को एकीकृत कैश के रूप में या विभाजित अनुदेश और डेटा कैश के रूप में कॉन्फ़िगर किया जा सकता है। उत्तरार्द्ध कॉन्फ़िगरेशन में, प्रत्येक कैश में 128 KB से 2 MB की क्षमता हो सकती है।[2] द्वितीयक कैश को भौतिक रूप से अनुक्रमित किया जाता है, भौतिक रूप से टैग किया जाता है और इसमें 128, 256, 512 या 1,024 बाइट्स का प्रोग्राम लाइन आकार होता है। कैश कंट्रोलर ऑन-डाई होता है। कैशे स्टैण्डर्ड स्टैटिक रैंडम एक्सेस मेमोरी (एसआरएएम) से बनाया गया है। डेटा और टैग बसों को ईसीसी-संरक्षित किया जाता है।

सिस्टम बस

आर4000 में SysAD बस के रूप में 64-बिट सिस्टम बस का उपयोग होता है। SysAD बस एक एड्रेस और डेटा मल्टीप्लेक्स्ड बस है, अर्थात यह डेटा और एड्रेस को स्थानांतरित करने के लिए एक ही वायर सेट का उपयोग करता है। हालाँकि यह बैंडविड्थ कम करता है, लेकिन सिस्टम की जटिलता को बढ़ाने वाले एड्रेस बस की तुलना में कम लागतग्रस्त होता है, जिसमें अधिक पिन की आवश्यकता होती है। SysAD बस को आंतरिक क्लॉक फ्रिक्वेंसी का आधा, तिहाई या चौथाई रूप में कार्यान्वित करने के लिए कॉन्फ़िगर किया जा सकता है। SysAD बस अपने क्लॉक सिग्नल को आपरेटिंग आवृत्ति से विभाजित करके उत्पन्न करता है।

ट्रांजिस्टर काउंट, डाई डायमेंशन्स और प्रक्रिया विवरण

आर4000 में 1.2 मिलियन ट्रांजिस्टर होता हैं।[3] इसे 1.0 μm दो-परत धातु पूरक धातु-ऑक्साइड-अर्धचालक (सीएमओएस) प्रक्रिया के लिए डिज़ाइन किया गया था। चूँकि एमआईपीएस एक फ़ेबलेस कंपनी थी, आर4000 को सहभागियों द्वारा अपनी प्रक्रियाओं में निर्मित किया गया था, जिसका न्यूनतम फीचर साइज 0.8 μm था।[4]

क्लॉकिंग

आर4000 बाह्‍यतः उत्पन्न एक मास्टर क्लॉक सिग्नल से विभिन्न क्लॉक सिग्नल उत्पन्न करता है। ऑपरेटिंग फ़्रीक्वेंसी के लिए, आर4000 ऑन-डाई फेज़-लॉक लूप (पीएलएल) के उपयोग से मास्टर क्लॉक सिग्नल को दो से गुणा करता है।

पैकेजिंग

आर4000पीसी को 179-पिन सिरेमिक पिन ग्रिड ऐरे (सीपीजीए) में पैकेज किया जाता है। आर4000एससी और आर4000एमसी को 447-पिन सिरेमिक स्टैगर्ड पिन ग्रिड ऐरे (एसपीजीए) में पैकेज किया जाता है। आर4000एमसी का पिन आउट आर4000एससी से भिन्न होता है, जहां आर4000एससी पर अप्रयोगित कुछ पिन आर4000एमसी पर कैश समन्वय को कार्यान्वित करने के लिए सिग्नल के लिए उपयोग किए जाते हैं। आर4000पीसी का पिन आउट पीजीए-पैकेज आर4200 और आर4600 माइक्रोप्रोसेसर के समान होता है। यह विशेषता एक योग्य डिज़ाइन किए गए सिस्टम को किसी भी तीन माइक्रोप्रोसेसर का उपयोग करने की संभावना प्रदान करती है।

आर4400

तोशिबा द्वारा निर्मित आर4400एमसी माइक्रोप्रोसेसर का एक उदाहरण
एनईसी वीआर4400एमसी डाई शॉट

आर4400, आर4000 का अग्रिम के अन्य विकास का उदाहरण है। इसे नवंबर 1992 के पहले सप्ताह में घोषित किया गया था। माइक्रोप्रोसेसर के प्रतिदर्श जनवरी 1993 में सामान्य उपलब्धता के साथ चयनित ग्राहकों को भेज दिए गए थे। आर4400 की क्लॉक आवृत्तियाँ 100, 133, 150, 200 और 250 MHz होती हैं। R4000 से केवल मुख्य कैश में बड़ा संशोधन होता है, जिनकी क्षमता 8 KB से प्रत्येक 16 KB तक दोगुनी कर दी गई। इसमें 2.3 मिलियन ट्रांजिस्टर्स होते हैं।

आर4400 को इंटीग्रेटेड डिवाइस टेक्नोलॉजी (आईडीटी), एलएसआई लॉजिक, एनईसी, परफॉर्मेंस सेमीकंडक्टर, सीमेंस एजी और तोशीबा द्वारा लाइसेंस प्राप्त था। आईडीटी, एनईसी, सीमेंस और तोशिबा ने माइक्रोप्रोसेसर का निर्माण और विपणन किया। एलएसआई लॉजिक ने कस्टम उत्पादों में आर4400 का उपयोग किया। परफॉर्मेंस अर्धचालक ने अपना लॉजिक डिवीजन साइप्रस अर्धचालक को बेच दिया जहां एमआईपीएस माइक्रोप्रोसेसर उत्पादों को संवृत कर दिया गया।

एनईसी ने अपने संस्करण को वीआर4400 के रूप में विपणन किया। प्रथम संस्करण, 150 MHz भाग, नवंबर 1992 में घोषित किया गया था। प्रारंभिक संस्करण 0.6 μm प्रक्रिया में निर्मित किए गए थे।[5] 1995 के मध्य में, 250 MHz भाग का प्रतिदर्श लेना शुरू किया गया। इसे 0.35 μm चार-परत-धातु प्रक्रिया में निर्मित किया गया था।[6] एनईसी ने एमआर4401, सिरेमिक मल्टी-चिप मॉड्यूल (एमसीएम) भी तैयार किया, जिसमें दस 1 Mbit एसआरएएम चिप्स के साथ वीआर4400एससी सम्मिलित था, जो 1 MB सेकेंडरी कैश को लागू करता था। एमसीएम आर4x00पीसी के साथ पिन-संगत था। प्रथम संस्करण, 150 MHz भाग की घोषणा 1994 में की गई थी। 1995 में, 200 MHz भाग की घोषणा की गई थी।

तोशिबा ने अपना संस्करण टीसी86आर4400 के रूप में विपणन किया। 200 MHz भाग जिसमें 2.3 मिलियन ट्रांजिस्टर हैं और 0.3 μm प्रक्रिया में निर्मित 134 mm2 माप है, 1994 के मध्य में प्रस्तुत किया गया था। 10,000 की मात्रा में आर4400पीसी की लागत $1,600, आर4400एससी की लागत $1,950, और आर4400एमसी की लागत $2,150 थी।[7]

उपयोग

आर4400 का उपयोग निम्न द्वारा किया जाता है:

चिपसेट

आर4000 और आर4400 माइक्रोप्रोसेसरों को कस्टम एएसआईसी या व्यावसायिक रूप से उपलब्ध चिपसेट द्वारा सिस्टम में इंटरफ़ेस किया गया था। एसजीआई जैसे सिस्टम विक्रेताओं ने अपने सिस्टम के लिए अपने स्वयं के एएसआईसी विकसित किए। तोशिबा जैसी कंपनियों द्वारा अपने टाइगर शार्क चिपसेट के साथ वाणिज्यिक चिपसेट विकसित, निर्मित और विपणन किए गए, जो आई486-संगत बस प्रदान करते थे।[13]

टिप्पणियाँ

  1. ↑ MIPS R4000 Microprocessor User's Manual, Second Edition, p. 152
  2. ↑ Heinrich, "MIPS R4000 Microprocessor User's Manual", p. 248
  3. ↑ Mirapuri, "The Mips R4000 Processor", p. 10
  4. ↑ Mirapuri, "The Mips R4000 Processor", p. 21
  5. ↑ "NEC VR4400 Clock-Doubling RISC Has 2m Transistors"
  6. ↑ "NEC Ready With 250MHz Version Of The 64-Bit MIPS R4400 RISC"
  7. ↑ "Toshiba Has 200MHz MIPS R4400"
  8. ↑ "...And From Carrera Computers"
  9. ↑ "Concurrent Multiprocessors Feature New Bus Architecture"
  10. ↑ "MIPS R-Based Windows NT Personal Computers From Deskstation..."
  11. ↑ "NEC Goes After The Business Market With Its Latest Line Of RISC UNIX Workstations"
  12. ↑ "Pyramid Technology Aims To Crash The Mainframe With Nile Series"
  13. ↑ "Toshiba Samples 80486-Bus Chip Set For R-Series".


संदर्भ

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