आईबीएम 7030 स्ट्रेच: Difference between revisions

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|-
|-
|| 0 || $Z || 64-bit zero: always reads as zero, cannot be changed by writes
|| 0 || $जेड || 64-बिट शून्य: सदैव शून्य के रूप में पढ़ता है, इसको लिखकर परिवर्तित नहीं जा सकता हैं
|| Main core storage
|| मुख्य कोर संग्रहण
|-
|-
|rowspan="2"| 1
|rowspan="2"| 1
|| $IT || interval timer (bits 0..18): decremented at 1024 Hz, recycles about every 8.5 minutes, at zero it turns on the "time signal indicator" in the indicator register
|| $आईटी ||अंतराल टाइमर (बिट्स 0..18): 1024 हर्ट्ज पर घटता है, सामान्यता यह प्रत्येक 8.5 मिनट में रीसायकल करता है, शून्य पर यह संकेतक रजिस्टर में "समय संकेत संकेतक" प्रारंभ करता है
|rowspan="2"| Index core storage
|rowspan="2"| सूचकांक कोर संग्रहण
|-
|-
|| $TC || 36-bit time clock (bits 28..63): count of 1024 Hz ticks, bits 38..63 increment once per second, recycles each ~777 days.
|| $टीसी ||36-बिट टाइम क्लॉक (बिट्स 28..63): 1024 हर्ट्ज टिकों की गिनती, बिट्स 38..63 वृद्धि प्रति सेकंड अनेक बार, प्रत्येक ~777 दिनों में रीसायकल होती है।
|-
|-
|| 2
|| 2
|| $IA || 18-bit interruption address
|| $आई.ए ||18-बिट व्यवधान एड्रेस
|| Main core storage
|| मुख्य कोर संग्रहण
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|rowspan="3"| 3
|rowspan="3"| 3
||$UB || 18-bit upper boundary address (bits 0-17)
||$यूबी ||18-बिट ऊपरी सीमा एड्रेस (बिट्स 0-17)
|rowspan="3"| Transistor register
|rowspan="3"| ट्रांजिस्टर रजिस्टर
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||$LB || 18-bit lower boundary address (bits 32-49)
||$एलबी ||18-बिट निचली सीमा एड्रेस (बिट्स 32-49)
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|| || 1-bit boundary control (bit 57): determines whether addresses within or outside the boundary addresses are protected
|| ||1-बिट सीमा नियंत्रण (बिट 57): यह निर्धारित करता है कि सीमा एड्रेस के अन्दर या बाहर के एड्रेस से सुरक्षित हैं या नहीं हैं
|-
|-
|| 4
|| 4
|| || 64-bit maintenance bits: only used for maintenance
|| ||64-बिट मेंटेनेंस बिट्स: केवल मेंटेनेंस के लिए उपयोग किया जाता है
|| Main core storage
|| मुख्य कोर संग्रहण
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|-
|| 5
|| 5
|| $CA || channel address (bits 12..18): readonly, set by the "exchange", an i/o processor
|| $सीए ||चैनल एड्रेस (बिट्स 12..18): केवल पढ़ने के लिए, "एक्सचेंज" द्वारा सेट, आई/ओ प्रोसेसर
|| Transistor register
|| ट्रांजिस्टर रजिस्टर
|-
|-
|| 6
|| 6
|| $CPUS || other CPU bits (bits 0..18): signaling mechanism for a cluster of up to 20 CPUs
|| $सीपीयूएस ||अन्य सीपीयू बिट्स (बिट्स 0..18): 20 सीपीयू तक के क्लस्टर के लिए सिग्नलिंग तंत्र
|| Transistor register
|| ट्रांजिस्टर रजिस्टर
|-
|-
|rowspan="2"| 7
|rowspan="2"| 7
|| $LZC || left zeroes count (bits 17..23): number of leading zero bits from a connective result or floating point operation
|| $एलजेडसी ||बाएँ शून्य की गिनती (बिट्स 17..23): संयोजी परिणाम या फ़्लोटिंग पॉइंट ऑपरेशन से अग्रणी शून्य बिट्स की संख्या
|rowspan="2"| Transistor register
|rowspan="2"| ट्रांजिस्टर रजिस्टर
|-
|-
|| $AOC || all-ones count (bits 44..50): count of bits set in connective result or decimal multiple or divide
|| $एओसी ||सभी की गिनती (बिट्स 44..50): संयोजी परिणाम या दशमलव एकाधिक या विभाजित में सेट बिट्स की गिनती होती हैं
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|-
|| 8
|| 8
|| $L || Left half of 128-bit [[Accumulator (computing)|accumulator]]
|| $एल || 128-बिट का बायां आधा [[Accumulator (computing)|संचायक]]
|rowspan="3"| Transistor register
|rowspan="3"| ट्रांजिस्टर रजिस्टर
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|-
|| 9
|| 9
|| $R || Right half of 128-bit accumulator
|| $आर ||128-बिट संचायक का दायां आधा भाग
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|-
|| 10
|| 10
|| $SB || accumulator sign byte (bits 0..7)
|| $एसबी ||संचायक साइन बाइट (बिट्स 0..7)
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|-
|| 11
|| 11
|| $IND || indicator register (bits 0..19)
|| $आईएनडी ||सूचक रजिस्टर (बिट्स 0..19)
|| Transistor register
|| ट्रांजिस्टर रजिस्टर
|-
|-
|| 12
|| 12
|| $MASK || 64-bit mask register: bits 0..19 always 1, bits 20..47 writable, bits 48..63 always 0
|| $एमएएसके ||64-बिट मास्क रजिस्टर: बिट्स 0..19 सदैव 1, बिट्स 20..47 लिखने योग्य, बिट्स 48..63 सदैव 0
|| Transistor register
|| ट्रांजिस्टर रजिस्टर
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|-
|| 13
|| 13
|| $RM || 64-bit remainder register: set by integer and floating point divide instructions only
|| $आरएम ||64-बिट शेष रजिस्टर: केवल पूर्णांक और फ़्लोटिंग पॉइंट डिवाइड निर्देशों द्वारा सेट किया गया हैं
|| Main core storage
|| मुख्य कोर संग्रहण
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|-
|| 14
|| 14
|| $FT || 64-bit factor register: changed only by the "load factor" instruction
|| $एफटी ||64-बिट फैक्टर रजिस्टर: केवल "लोड फैक्टर" निर्देश द्वारा परिवर्तित किया गया हैं
|| Main core storage
|| मुख्य कोर संग्रहण
|-
|-
|| 15
|| 15
|| $TR || 64-bit transit register
|| $टीआर ||64-बिट ट्रांजिट रजिस्टर
|| Main core storage
|| मुख्य कोर संग्रहण
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|-
|| 16<br>...<br>31
|| 16<br>...<br>31
|| $X0<br>...<br>$X15 || 64-bit index registers (sixteen)
|| $एक्स0<br>...<br>$एक्स15 || 64-बिट इंडेक्स रजिस्टर (सिक्सटीन)
|| Index core storage
|| सूचकांक कोर संग्रहण
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संचायक और सूचकांक रजिस्टर हस्ताक्षरित संख्या अभ्यावेदन#चिह्न-परिमाण|चिह्न-और-परिमाण प्रारूप में काम करते हैं।
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Revision as of 10:02, 9 August 2023

आईबीएम स्ट्रेच
File:आईबीएम 7030-सीएनएएम 22480-आईएमजी 5115-ग्रेडिएंट.jpg
आईबीएम 7030 रखरखाव कंसोल पर मुसी देस आर्ट्स एट मेटियर्स, पेरिस
Design
Manufacturerआईबीएम
Designerजीन अमदाहl
Release dateमई 1961 (मई 1961)
Units sold9
PriceUS$7,780,000 (equivalent to $70,550,000 in 2021)
Casing
Weight70,000 pounds (35 short tons; 32 t)[1]
Power100 किलोवाट[1] @ 110 V
System
Operating systemएमसीपी
CPU64-बिट प्रोसेसर
Memory2048 किलोबाइट (262,144 x 64 बिट्स)[1]
MIPS1.2 एमआईपीएस

IBM 7030, जिसे स्ट्रेच के नाम से भी जाना जाता है, IBM का पहला ट्रांजिस्टर कंप्यूटर सुपर कंप्यूटर था। 1961 से 1964 में पहला सीडीसी 6600 चालू होने तक यह दुनिया का सबसे तेज़ कंप्यूटर था।[2][3]

मूल रूप से लॉरेंस लिवरमोर राष्ट्रीय प्रयोगशाला में एडवर्ड टेलर द्वारा तैयार की गई आवश्यकता को पूरा करने के लिए डिज़ाइन किया गया था, पहला उदाहरण 1961 में लॉस अलामोस राष्ट्रीय प्रयोगशाला को दिया गया था, और दूसरा अनुकूलित संस्करण, आईबीएम 7950 हार्वेस्ट, 1962 में राष्ट्रीय सुरक्षा एजेंसी को दिया गया था। आरएएफ एल्डरमैस्टन, इंग्लैंड में परमाणु हथियार अनुसंधान प्रतिष्ठान में वहां के शोधकर्ताओं और परमाणु ऊर्जा अनुसंधान प्रतिष्ठान में इसका भारी उपयोग किया गया था, लेकिन केवल एस2 फोरट्रान कंपाइलर के विकास के बाद, जो गतिशील सरणियों को जोड़ने वाला पहला था, और जिसे बाद में पोर्ट किया गया था चिल्टन में एटलस कंप्यूटर प्रयोगशाला का एटलस (कंप्यूटर)।[4][5]

7030 अपेक्षा से बहुत धीमा था और अपने आक्रामक प्रदर्शन लक्ष्यों को पूरा करने में विफल रहा। आईबीएम को अपनी कीमत 13.5 मिलियन डॉलर से घटाकर केवल 7.78 मिलियन डॉलर करने के लिए मजबूर होना पड़ा और पहले से ही अनुबंध पर बातचीत करने वाले ग्राहकों से परे बिक्री से 7030 वापस ले लिया गया। पीसी की दुनिया पत्रिका ने स्ट्रेच को सूचना प्रौद्योगिकी इतिहास की सबसे बड़ी परियोजना प्रबंधन विफलताओं में से बताया।[6]

आईबीएम के भीतर, छोटे नियंत्रण डेटा निगम द्वारा ग्रहण किए जाने को स्वीकार करना कठिन लग रहा था।[7] प्रोजेक्ट लीड, Stephen W. Dunwell [de],[8] शुरुआत में विफलता में उनकी भूमिका के लिए उन्हें बलि का बकरा बनाया गया था,[9] लेकिन जैसे ही आईबीएम सिस्टम/360 की सफलता स्पष्ट हो गई, उनसे आधिकारिक माफी मांगी गई और 1966 में उन्हें आईबीएम फेलो बना दिया गया।[10]

स्ट्रेच की अपने स्वयं के प्रदर्शन लक्ष्यों को पूरा करने में विफलता के बावजूद, इसने सफल आईबीएम सिस्टम/360 की कई डिज़ाइन विशेषताओं के आधार के रूप में कार्य किया, जिसकी घोषणा 1964 में की गई थी और पहली बार 1965 में शिप की गई थी।

विकास इतिहास

1955 की शुरुआत में, कैलिफोर्निया विश्वविद्यालय की विकिरण प्रयोगशाला के डॉ. एडवर्ड टेलर त्रि-आयामी द्रव गतिकी गणना के लिए नई वैज्ञानिक कंप्यूटिंग प्रणाली चाहते थे। इस नई प्रणाली के लिए IBM और UNIVAC से प्रस्तावों का अनुरोध किया गया था, जिसे लिवरमोर ऑटोमैटिक रिएक्शन कैलकुलेटर या UNIVAC LARC कहा जाएगा। आईबीएम के कार्यकारी कथबर्ट हर्ड के अनुसार, इस तरह की प्रणाली की लागत लगभग 2.5 मिलियन डॉलर होगी और यह प्रति सेकंड से दो मिलियन निर्देशों पर चलेगी।[11]: 12 कॉन्ट्रैक्ट साइन होने के दो से तीन साल बाद डिलीवरी होनी थी।

आईबीएम में, जॉन ग्रिफ़िथ और जीन अमदहल सहित पॉकीप्सी, न्यूयॉर्क की छोटी टीम ने डिज़ाइन प्रस्ताव पर काम किया। जैसे ही वे समाप्त करके प्रस्ताव प्रस्तुत करने वाले थे, राल्फ पामर ने उन्हें रोका और कहा, यह गलती है।[11]: 12  प्रस्तावित डिज़ाइन या तो बिंदु-संपर्क ट्रांजिस्टर या सतह-अवरोध ट्रांजिस्टर के साथ बनाया गया होगा, दोनों के जल्द ही तत्कालीन नए आविष्कृत प्रसार ट्रांजिस्टर से बेहतर प्रदर्शन होने की संभावना है।[11]: 12 

आईबीएम लिवरमोर लौट आया और कहा कि वे अनुबंध से हट रहे हैं, और इसके बजाय नाटकीय रूप से बेहतर प्रणाली का प्रस्ताव रखा, हम आपके लिए वह मशीन नहीं बनाने जा रहे हैं; हम कुछ बेहतर बनाना चाहते हैं! हम ठीक से नहीं जानते कि इसमें कितना खर्च आएगा, लेकिन हमें लगता है कि इसमें मिलियन डॉलर और और साल लगेगा, और हम नहीं जानते कि यह कितनी तेजी से चलेगा, लेकिन हम प्रति सेकंड दस मिलियन निर्देशों के लिए शूट करना चाहेंगे।[11]: 13  लिवरमोर प्रभावित नहीं हुए और मई 1955 में उन्होंने घोषणा की कि UNIVAC ने UNIVAC LARC अनुबंध जीत लिया है, जिसे अब लिवरमोर ऑटोमैटिक रिसर्च कंप्यूटर कहा जाता है। LARC अंततः जून 1960 में वितरित किया जाएगा।[12] सितंबर 1955 में, इस डर से कि लॉस एलामोस नेशनल लेबोरेटरी भी LARC का आदेश दे सकती है, IBM ने डिज़ाइन के उन्नत संस्करण के आधार पर उच्च-प्रदर्शन वाले बाइनरी कंप्यूटर के लिए प्रारंभिक प्रस्ताव प्रस्तुत किया, जिसे लिवरमोर ने अस्वीकार कर दिया था, जिसे उन्होंने रुचि के साथ प्राप्त किया। जनवरी 1956 में, प्रोजेक्ट स्ट्रेच औपचारिक रूप से शुरू किया गया था। नवंबर 1956 में, आईबीएम ने आईबीएम 704 (यानी 4 एमआईपीएस) से कम से कम 100 गुना गति के आक्रामक प्रदर्शन लक्ष्य के साथ अनुबंध जीता। डिलीवरी 1960 के लिए निर्धारित की गई थी।

डिजाइन के दौरान, घड़ी की गति को कम करना आवश्यक साबित हुआ, जिससे यह स्पष्ट हो गया कि स्ट्रेच अपने आक्रामक प्रदर्शन लक्ष्यों को पूरा नहीं कर सका, लेकिन प्रदर्शन का अनुमान आईबीएम 704 से 60 से 100 गुना तक था। 1960 में, आईबीएम 7030 के लिए 13.5 मिलियन डॉलर की कीमत निर्धारित की गई थी। 1961 में, वास्तविक बेंचमार्क (कंप्यूटिंग) ने संकेत दिया कि आईबीएम 7030 का प्रदर्शन आईबीएम 70 से केवल 30 गुना अधिक था। 4 (यानी 1.2 एमआईपीएस), जिससे आईबीएम को काफी शर्मिंदगी उठानी पड़ी। मई 1961 में, थॉमस जे. वॉटसन जूनियर ने बातचीत के तहत सभी 7030 की कीमत में कटौती करके 7.78 मिलियन डॉलर करने और आगे की बिक्री से उत्पाद को तत्काल वापस लेने की घोषणा की।

इसका फ़्लोटिंग-पॉइंट अंकगणित | फ़्लोटिंग-पॉइंट जोड़ समय 1.38-1.50 माइक्रोसेकंड है, गुणन समय 2.48-2.70 माइक्रोसेकंड है, और विभाजन समय 9.00-9.90 माइक्रोसेकंड है।

तकनीकी प्रभाव

जबकि IBM 7030 को सफल नहीं माना गया, इसने भविष्य की मशीनों में शामिल कई तकनीकों को जन्म दिया जो अत्यधिक सफल रहीं। मानक मॉड्यूलर सिस्टम ट्रांजिस्टर तर्क वैज्ञानिक कंप्यूटरों की आईबीएम 7090 लाइन, आईबीएम 7070 और आईबीएम 7080 बिजनेस कंप्यूटर, आईबीएम 7040 और आईबीएम 1400 श्रृंखला लाइनों और आईबीएम 1620 छोटे वैज्ञानिक कंप्यूटर का आधार था; 7030 के बारे में प्रयोग किया जाता है 170,000 ट्रांजिस्टर. आईबीएम 7302 मॉडल I कोर स्टोरेज इकाइयों का उपयोग IBM 7090, IBM 7070 और IBM 7080 में भी किया गया था। कंप्यूटर मल्टीटास्किंग, मेमोरी सुरक्षा, सामान्यीकृत इंटरप्ट, I/O के लिए आठ-बिट बाइट[lower-alpha 1] सभी अवधारणाओं को बाद में आईबीएम सिस्टम/360 लाइन के कंप्यूटरों के साथ-साथ सबसे बाद की केंद्रीय प्रसंस्करण इकाइयों (सीपीयू) में शामिल किया गया।

प्रोजेक्ट मैनेजर स्टीफन डनवेल, जो स्ट्रेच के व्यावसायिक रूप से विफल होने पर बलि का बकरा बन गए थे, ने 1964 में सिस्टम/360 के अभूतपूर्व रूप से सफल लॉन्च के तुरंत बाद बताया कि इसकी अधिकांश मुख्य अवधारणाओं को स्ट्रेच द्वारा आगे बढ़ाया गया था।[13] 1966 तक उन्हें माफी मिल चुकी थी और उन्हें आईबीएम फेलो बना दिया गया था, यह उच्च सम्मान था जो किसी के वांछित शोध को आगे बढ़ाने के लिए संसाधनों और अधिकार के साथ आता था।[13]

निर्देश पाइपलाइनिंग, निर्देश प्रीफ़ेच और डिकोडिंग, और मेमोरी इंटरलीविंग का उपयोग बाद के सुपरकंप्यूटर डिज़ाइनों में किया गया जैसे कि आईबीएम सिस्टम/360 मॉडल आईबीएम सिस्टम/360 मॉडल 91, आईबीएम सिस्टम/360 मॉडल 91 और आईबीएम सिस्टम/360 मॉडल 195, और आईबीएम 3090 श्रृंखला के साथ-साथ अन्य निर्माताओं के कंप्यूटर। As of 2021, इन तकनीकों का उपयोग अभी भी अधिकांश उन्नत माइक्रोप्रोसेसरों में किया जाता है, जिसकी शुरुआत 1990 के दशक की पीढ़ी से हुई थी जिसमें इंटेल पेंटियम और मोटोरोला/आईबीएम पावरपीसी, साथ ही विभिन्न निर्माताओं के कई एम्बेडेड माइक्रोप्रोसेसर और माइक्रोकंट्रोलर शामिल थे।

हार्डवेयर कार्यान्वयन

ब्रैडबरी विज्ञान संग्रहालय, लॉस एलामोस, न्यू मैक्सिको में आईबीएम 7030 का सर्किट बोर्ड।

7030 सीपीयू एमिटर-युग्मित तर्क (मूल रूप से वर्तमान-स्टीयरिंग तर्क कहा जाता है) का उपयोग करता है[14] 18 प्रकार के स्टैंडर्ड मॉड्यूलर सिस्टम (एसएमएस) कार्ड पर। इसमें 4,025 डबल कार्ड (जैसा कि दिखाया गया है) और 18,747 सिंगल कार्ड का उपयोग किया गया है, जिसमें 169,100 ट्रांजिस्टर हैं, जिसके लिए कुल 21 किलोवाट बिजली की आवश्यकता होती है।[15]: 54  यह उच्च गति वाले एनपीएन और पीएनपी जर्मेनियम बहाव ट्रांजिस्टर का उपयोग करता है, जिसकी कट-ऑफ आवृत्ति 100 मेगाहर्ट्ज से अधिक है, और प्रत्येक ~50 मेगावाट का उपयोग करता है।[15]: 57  कुछ तीसरे स्तर के सर्किट तीसरे वोल्टेज स्तर का उपयोग करते हैं। प्रत्येक तर्क स्तर में लगभग 20 एनएस की देरी होती है। महत्वपूर्ण क्षेत्रों में गति प्राप्त करने के लिए एमिटर-युग्मित लॉजिक|एमिटर-फॉलोअर लॉजिक का उपयोग विलंब को लगभग 10 एनएस तक कम करने के लिए किया जाता है।[15]: 55 

यह IBM 7090 के समान ही कोर मेमोरी का उपयोग करता है।[15]: 58 

स्थापना

  1. लॉस एलामोस वैज्ञानिक प्रयोगशाला (एलएएसएल) अप्रैल 1961 में, मई 1961 में स्वीकृत, और 21 जून 1971 तक उपयोग किया गया।
  2. लॉरेंस लिवरमोर नेशनल लेबोरेटरी, लिवरमोर, कैलिफोर्निया नवंबर 1961 में वितरित किया गया।[16]#हम। फरवरी 1962 में राष्ट्रीय सुरक्षा एजेंसी ने आईबीएम 7950 हार्वेस्ट सिस्टम के मुख्य सीपीयू के रूप में उपयोग किया, जिसका उपयोग 1976 तक किया गया, जब आईबीएम 7955 ट्रैक्टर टेप सिस्टम में घिसे हुए कैम के कारण समस्याएँ पैदा हुईं जिन्हें बदला नहीं जा सका।
  3. परमाणु हथियार प्रतिष्ठान, एल्डरमैस्टन, इंग्लैंड, फरवरी 1962 में वितरित किया गया[16]
  4. राष्ट्रीय मौसम सेवा|यू.एस. मौसम ब्यूरो वाशिंगटन डी.सी., जून/जुलाई 1962 में वितरित।[16]#मेटर कॉर्पोरेशन, दिसंबर 1962 को वितरित किया गया।[16]और अगस्त 1971 तक उपयोग किया गया। 1972 के वसंत में, इसे ब्रिघम यंग यूनिवर्सिटी को बेच दिया गया, जहां 1982 में समाप्त होने तक इसका उपयोग भौतिकी विभाग द्वारा किया जाता था।
  5. हम। नेवी नेवल सरफेस वारफेयर सेंटर डहलग्रेन डिवीजन, सितंबर/अक्टूबर 1962 को वितरित किया गया।[16]#फ्रांसीसी वैकल्पिक ऊर्जा और परमाणु ऊर्जा आयोग|परमाणु ऊर्जा आयोग, फ़्रांस, नवंबर 1963 में वितरित।[16]#आईबीएम.

लॉरेंस लिवरमोर प्रयोगशाला की IBM 7030 (इसकी मुख्य मेमोरी को छोड़कर) और MITER Corporation/ब्रिघम यंग यूनिवर्सिटी IBM 7030 के हिस्से अब माउंटेन व्यू, कैलिफ़ोर्निया में कंप्यूटर इतिहास संग्रहालय संग्रह में मौजूद हैं।

वास्तुकला

डेटा प्रारूप

  • निश्चित-बिंदु अंकगणित|निश्चित-बिंदु संख्याएँ लंबाई में परिवर्तनशील होती हैं, जो या तो बाइनरी (1 से 64 बिट्स) या दशमलव (1 से 16 अंक) और या तो अहस्ताक्षरित प्रारूप या कंप्यूटर संख्या प्रारूप|चिह्न/परिमाण प्रारूप में संग्रहीत होती हैं। दशमलव प्रारूप में, अंक परिवर्तनीय लंबाई बाइट्स (4 से 8 बिट्स) होते हैं।
  • तैरनेवाला स्थल नंबरों में 1-बिट एक्सपोनेंट फ़्लैग, 10-बिट एक्सपोनेंट, 1-बिट एक्सपोनेंट साइन, 48-बिट परिमाण और साइन/परिमाण प्रारूप में 4-बिट साइन बाइट होता है।
  • अल्फ़ान्यूमेरिक वर्ण परिवर्तनशील लंबाई के होते हैं और 8 बिट या उससे कम के किसी भी वर्ण कोड का उपयोग कर सकते हैं।
  • बाइट्स परिवर्तनीय लंबाई (1 से 8 बिट्स) हैं।[17]


निर्देश प्रारूप

निर्देश या तो 32-बिट या 64-बिट हैं।

रजिस्टर

जैसा कि दिखाया गया है, रजिस्टर मेमोरी के पहले 32 पतों को ओवरले करते हैं।[18]

पता स्मृति सहायक पंजीकृत स्टोर्ड इन:
0 $जेड 64-बिट शून्य: सदैव शून्य के रूप में पढ़ता है, इसको लिखकर परिवर्तित नहीं जा सकता हैं मुख्य कोर संग्रहण
1 $आईटी अंतराल टाइमर (बिट्स 0..18): 1024 हर्ट्ज पर घटता है, सामान्यता यह प्रत्येक 8.5 मिनट में रीसायकल करता है, शून्य पर यह संकेतक रजिस्टर में "समय संकेत संकेतक" प्रारंभ करता है सूचकांक कोर संग्रहण
$टीसी 36-बिट टाइम क्लॉक (बिट्स 28..63): 1024 हर्ट्ज टिकों की गिनती, बिट्स 38..63 वृद्धि प्रति सेकंड अनेक बार, प्रत्येक ~777 दिनों में रीसायकल होती है।
2 $आई.ए 18-बिट व्यवधान एड्रेस मुख्य कोर संग्रहण
3 $यूबी 18-बिट ऊपरी सीमा एड्रेस (बिट्स 0-17) ट्रांजिस्टर रजिस्टर
$एलबी 18-बिट निचली सीमा एड्रेस (बिट्स 32-49)
1-बिट सीमा नियंत्रण (बिट 57): यह निर्धारित करता है कि सीमा एड्रेस के अन्दर या बाहर के एड्रेस से सुरक्षित हैं या नहीं हैं
4 64-बिट मेंटेनेंस बिट्स: केवल मेंटेनेंस के लिए उपयोग किया जाता है मुख्य कोर संग्रहण
5 $सीए चैनल एड्रेस (बिट्स 12..18): केवल पढ़ने के लिए, "एक्सचेंज" द्वारा सेट, आई/ओ प्रोसेसर ट्रांजिस्टर रजिस्टर
6 $सीपीयूएस अन्य सीपीयू बिट्स (बिट्स 0..18): 20 सीपीयू तक के क्लस्टर के लिए सिग्नलिंग तंत्र ट्रांजिस्टर रजिस्टर
7 $एलजेडसी बाएँ शून्य की गिनती (बिट्स 17..23): संयोजी परिणाम या फ़्लोटिंग पॉइंट ऑपरेशन से अग्रणी शून्य बिट्स की संख्या ट्रांजिस्टर रजिस्टर
$एओसी सभी की गिनती (बिट्स 44..50): संयोजी परिणाम या दशमलव एकाधिक या विभाजित में सेट बिट्स की गिनती होती हैं
8 $एल 128-बिट का बायां आधा संचायक ट्रांजिस्टर रजिस्टर
9 $आर 128-बिट संचायक का दायां आधा भाग
10 $एसबी संचायक साइन बाइट (बिट्स 0..7)
11 $आईएनडी सूचक रजिस्टर (बिट्स 0..19) ट्रांजिस्टर रजिस्टर
12 $एमएएसके 64-बिट मास्क रजिस्टर: बिट्स 0..19 सदैव 1, बिट्स 20..47 लिखने योग्य, बिट्स 48..63 सदैव 0 ट्रांजिस्टर रजिस्टर
13 $आरएम 64-बिट शेष रजिस्टर: केवल पूर्णांक और फ़्लोटिंग पॉइंट डिवाइड निर्देशों द्वारा सेट किया गया हैं मुख्य कोर संग्रहण
14 $एफटी 64-बिट फैक्टर रजिस्टर: केवल "लोड फैक्टर" निर्देश द्वारा परिवर्तित किया गया हैं मुख्य कोर संग्रहण
15 $टीआर 64-बिट ट्रांजिट रजिस्टर मुख्य कोर संग्रहण
16
...
31 		$एक्स0
...
$एक्स15		 64-बिट इंडेक्स रजिस्टर (सिक्सटीन) सूचकांक कोर संग्रहण

संचायक और सूचकांक रजिस्टर हस्ताक्षरित संख्या अभ्यावेदन#चिह्न-परिमाण|चिह्न-और-परिमाण प्रारूप में काम करते हैं।

स्मृति

मुख्य मेमोरी 16K के बैंकों में 16K से 256K 64-बिट बाइनरी शब्द है।

इसकी परिचालन विशेषताओं को स्थिर करने के लिए मेमोरी को तेल से गर्म/ठंडा किया गया था।

सॉफ़्टवेयर


यह भी देखें

टिप्पणियाँ

  1. ↑ While Stretch had instructions with variable byte sizes, no subsequent processor from IBM did. However, Burroughs, CDC, DEC, GE, RCA, UNIVAC and their successors had machines with multiple byte sizes; Burroughs, CDC and DEC had machines that supported any size from 1 to the word length.


संदर्भ

  1. ↑ 1.0 1.1 1.2 बीआरएल रिपोर्ट 1961
  2. ↑ "Designed by Seymour Cray, the CDC 6600 was almost three times faster than the next fastest machine of its day, the IBM 7030 Stretch." Making a World of Difference: Engineering Ideas into Reality. National Academy of Engineering. 2014. ISBN 978-0309312653.
  3. ↑ "In 1964 Cray's CDC 6600 replaced Stretch as the fastest computer on earth." Andreas Sofroniou (2013). EXPERT SYSTEMS, KNOWLEDGE ENGINEERING FOR HUMAN REPLICATION. ISBN 978-1291595093.
  4. ↑ "Some Early UK FORTRAN Compilers".
  5. ↑ "HARTRAN Overview".
  6. ↑ Widman, Jake (October 9, 2008). "Lessons Learned: IT's Biggest Project Failures". PCWorld. Retrieved October 23, 2012.
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अग्रिम पठन


बाहरी संबंध

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Records
Preceded by World's most powerful computer
1961–1963 		Succeeded by
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