कैस्कोड

कैस्कोड एक दो-चरण एम्पलीफायर है जिसमें सामान्य-एमिटर चरण होता है जो  सामान्य-बेस चरण में खिलाता है। एकल प्रवर्धक चरण की तुलना में, इस संयोजन में निम्नलिखित विशेषताओं में से एक या अधिक हो सकते हैं: उच्च इनपुट-आउटपुट अलगाव, उच्च इनपुट प्रतिबाधा, उच्च आउटपुट प्रतिबाधा, उच्च बैंडविड्थ (सिग्नल प्रोसेसिंग)।

आधुनिक सर्किट में, कैस्कोड अक्सर दो ट्रांजिस्टर (द्विध्रुवीय द्विध्रुवी जंक्शन ट्रांजिस्टर फील्ड इफ़ेक्ट ट्रांजिस्टर ) से बना होता है, जिसमें से  सामान्य उत्सर्जक या सामान्य स्रोत के रूप में काम करता है और दूसरा सामान्य आधार या सामान्य गेट के रूप में होता है। कैस्कोड इनपुट-आउटपुट अलगाव (रिवर्स ट्रांसमिशन को कम करता है) में सुधार करता है, क्योंकि आउटपुट से इनपुट तक कोई सीधा युग्मन नहीं होता है। यह मिलर प्रभाव को समाप्त करता है और इस प्रकार बहुत अधिक बैंडविड्थ में योगदान देता है।

कैस्कोड दो-चरण एम्पलीफायर है जिसमें  सामान्य-एमिटर चरण होता है जो  सामान्य-बेस चरण में खिलाता है।  ल प्रवर्धक चरण की तुलना में, इस संयोजन में निम्नलिखित

इतिहास
कैसकोड (कभी-कभी कैसकोडिंग के लिए क्रिया ) का उपयोग एनालॉग सर्किट प्रदर्शन में सुधार के लिए  सामान्य तकनीक है, जो  वेक्यूम - ट्यूब  और ट्रांजिस्टर दोनों पर लागू होता है। वोल्टेज स्टेबलाइजर्स के आवेदन पर चर्चा में 1939 में फ्रेडरिक विंटन हंट और रोजर वेन हिकमैन द्वारा लिखे गए एक लेख में कैसकोड नाम गढ़ा गया था। उन्होंने    कलम के साथ के प्रतिस्थापन के रूप में दो ट्रायोड ( सामान्य कैथोड सेटअप के साथ पहला,  सामान्य नियंत्रण ग्रिड वाला दूसरा) का  कैस्केड प्रस्तावित किया, और इसलिए नाम को कैस्क (एडेड ट्रायोड एम्पलीफायर) का संक्षिप्त नाम माना जा सकता है। विशेषताओं के समान, लेकिन एकल पेंट) ओड की तुलना में कम शोर। कम शोर और व्यापक बैंडविड्थ के कारण 'फ्रंट-एंड' या ट्यूनर के लिए प्रारंभिक टेलीविजन सेटों में कैस्कोड सर्किट नियोजित किए गए थे।

ऑपरेशन
चित्रा 1 सिग्नल स्रोत, वी द्वारा संचालित इनपुट चरण के रूप में  सामान्य स्रोत एम्पलीफायर के साथ  कैस्कोड एम्पलीफायर का  उदाहरण दिखाता हैin. यह इनपुट चरण आउटपुट सिग्नल वी के साथ आउटपुट चरण के रूप में सामान्य-गेट एम्पलीफायर चलाता हैout.

जैसा कि निचला FET संचालित करता है, यह ऊपरी FET के स्रोत वोल्टेज को बदलता है, और ऊपरी FET इसके गेट और स्रोत के बीच परिवर्तित क्षमता के कारण संचालित होता है।

इस सर्किट व्यवस्था का प्रमुख लाभ इनपुट (कम) FET के आउटपुट टर्मिनल (नाली) के भार के रूप में ऊपरी क्षेत्र-प्रभाव ट्रांजिस्टर (FET) की नियुक्ति से उपजा है। क्योंकि ऑपरेटिंग आवृत्तियों पर ऊपरी FET का गेट प्रभावी रूप से ग्राउंडेड होता है, ऊपरी FET का स्रोत वोल्टेज (और इसलिए इनपुट ट्रांजिस्टर की नाली) ऑपरेशन के दौरान लगभग स्थिर वोल्टेज पर आयोजित होता है। दूसरे शब्दों में, ऊपरी एफईटी निचले एफईटी के लिए कम इनपुट प्रतिरोध प्रदर्शित करता है, जिससे निचले एफईटी का वोल्टेज लाभ बहुत छोटा हो जाता है, जो नाटकीय रूप से मिलर प्रभाव फीडबैक कैपेसिटेंस को निचले एफईटी के नाले से गेट तक कम कर देता है। वोल्टेज लाभ का यह नुकसान ऊपरी FET द्वारा वसूल किया जाता है। इस प्रकार, ऊपरी ट्रांजिस्टर कम एफईटी को न्यूनतम नकारात्मक (मिलर) प्रतिक्रिया के साथ संचालित करने की अनुमति देता है, जिससे इसकी बैंडविड्थ में सुधार होता है।

ऊपरी FET गेट विद्युत रूप से ग्राउंडेड है, इसलिए आवारा समाई का चार्ज और डिस्चार्ज, Cdg, नाली और गेट के बीच केवल R से होकर जाता हैDऔर आउटपुट लोड (कहते हैं Rout), और आवृत्ति प्रतिक्रिया केवल संबद्ध आरसी समय स्थिर τ = C से ऊपर की आवृत्तियों के लिए प्रभावित होती हैdg RD//आरout, अर्थात् f = 1/(2πτ), उच्च आवृत्ति क्योंकि सीdgछोटा है। अर्थात्, ऊपरी FET गेट C के मिलर प्रवर्धन से ग्रस्त नहीं हैdg.

यदि ऊपरी FET चरण अकेले अपने स्रोत को इनपुट नोड (अर्थात, कॉमन-गेट (CG) कॉन्फ़िगरेशन) के रूप में उपयोग करके संचालित किया जाता है, तो इसमें अच्छा वोल्टेज लाभ और व्यापक बैंडविड्थ होगा। हालांकि, इसकी कम इनपुट प्रतिबाधा इसकी उपयोगिता को बहुत कम-प्रतिबाधा वोल्टेज चालकों तक सीमित कर देगी। उच्च इनपुट प्रतिबाधा में कम FET परिणाम जोड़ने से, कैस्कोड चरण को उच्च-प्रतिबाधा स्रोत द्वारा संचालित करने की अनुमति मिलती है।

यदि कोई ऊपरी FET को विशिष्ट आगमनात्मक/प्रतिरोधक भार के साथ प्रतिस्थापित करता है और इनपुट ट्रांजिस्टर के ड्रेन (अर्थात,  सामान्य-स्रोत (CS) कॉन्फ़िगरेशन) से आउटपुट लेता है, तो CS कॉन्फ़िगरेशन उसी इनपुट प्रतिबाधा की पेशकश करेगा जो कैस्कोड के रूप में होती है।, लेकिन कैस्कोड कॉन्फ़िगरेशन संभावित रूप से अधिक लाभ और बहुत अधिक बैंडविड्थ प्रदान करेगा।

स्थिरता
कैस्कोड व्यवस्था भी बहुत स्थिर है। इसका आउटपुट विद्युत और भौतिक दोनों तरह से इनपुट से प्रभावी रूप से अलग होता है। निचले ट्रांजिस्टर में नाली और स्रोत दोनों पर लगभग स्थिर वोल्टेज होता है, और इस प्रकार इसके गेट में वापस फीड करने के लिए अनिवार्य रूप से कुछ भी नहीं होता है। ऊपरी ट्रांजिस्टर के गेट और स्रोत पर लगभग स्थिर वोल्टेज होता है। इस प्रकार, उन पर महत्वपूर्ण वोल्टेज वाले एकमात्र नोड इनपुट और आउटपुट हैं, और इन्हें लगभग स्थिर वोल्टेज के केंद्रीय कनेक्शन और दो ट्रांजिस्टर की भौतिक दूरी से अलग किया जाता है। इस प्रकार व्यवहार में आउटपुट से इनपुट तक बहुत कम प्रतिक्रिया होती है। धातु परिरक्षण दोनों ट्रांजिस्टर के बीच आवश्यकता पड़ने पर और भी अधिक अलगाव के लिए प्रभावी और आसान दोनों है। यह -ट्रांजिस्टर एम्पलीफायर सर्किट में मुश्किल होगा, जो उच्च आवृत्तियों पर न्यूट्रोडाइन की आवश्यकता होगी।

पूर्वाग्रह
जैसा कि दिखाया गया है, दो स्टैक्ड FET का उपयोग करने वाला कैस्कोड सर्किट दो FET पर कुछ प्रतिबंध लगाता है - अर्थात्, ऊपरी FET को पक्षपाती होना चाहिए ताकि इसका स्रोत वोल्टेज पर्याप्त उच्च हो (कम FET ड्रेन वोल्टेज बहुत कम हो सकता है, जिससे यह संतृप्त हो सकता है)। एफईटी के लिए इस स्थिति को सुनिश्चित करने के लिए जोड़ी के लिए सावधानीपूर्वक चयन या ऊपरी एफईटी गेट के विशेष बायसिंग, बढ़ती लागत की आवश्यकता होती है।

कैसकोड सर्किट को द्विध्रुवी ट्रांजिस्टर, या एमओएसएफईटी, या एफईटी (या एमओएसएफईटी) और  बीजेटी का उपयोग करके भी बनाया जा सकता है। वीएचएफ टेलीविजन ट्यूनर में यह सर्किट व्यवस्था बहुत आम थी जब वे वैक्यूम ट्यूबों को नियोजित करते थे।

लाभ
कैस्कोड व्यवस्था उच्च लाभ, उच्च बैंडविड्थ, उच्च स्लीव दर, उच्च स्थिरता और उच्च इनपुट प्रतिबाधा प्रदान करती है। दो-ट्रांजिस्टर सर्किट के रूप में, पुर्जों की संख्या बहुत कम है।

नुकसान
कैस्कोड सर्किट को दो ट्रांजिस्टर की आवश्यकता होती है और अपेक्षाकृत उच्च आपूर्ति वोल्टेज की आवश्यकता होती है। दो-एफईटी कैस्कोड के लिए, दोनों ट्रांजिस्टर को पर्याप्त वी के साथ पक्षपाती होना चाहिएDS संचालन में, आपूर्ति वोल्टेज पर निचली सीमा लागू करना।

डुअल-गेट संस्करण
मल्टीगेट डिवाइस | डुअल-गेट MOSFET अक्सर -ट्रांजिस्टर कैस्कोड के रूप में कार्य करता है. संवेदनशील बहुत उच्च आवृत्ति रिसीवर के सामने के छोर में आम, एक दोहरे गेट MOSFET को इनपुट से जुड़े प्राथमिक गेट (आमतौर पर MOSFET निर्माताओं द्वारा निर्दिष्ट गेट 1) के साथ सामान्य-स्रोत एम्पलीफायर के रूप में संचालित किया जाता है और दूसरा गेट ग्राउंडेड (बाईपास) होता है।. आंतरिक रूप से, दो निकटवर्ती फाटकों द्वारा कवर किया गया चैनल है; इसलिए, परिणामी सर्किट विद्युत रूप से दो एफईटी से बना  कैस्कोड है, सामान्य निचला-नाली-से-ऊपरी-स्रोत कनेक्शन केवल एकल चैनल का वह हिस्सा है जो दो फाटकों के बीच की सीमा के निकट भौतिक रूप से स्थित है।

सुपरहेट्रोडाइन रिसीवर्स में मिक्सर
सुपरहेटरोडाइन रिसीवर्स में गुणा आवृत्ति मिक्सर सर्किट के रूप में कैस्कोड सर्किट बहुत उपयोगी है। निचले गेट पर आरएफ सिग्नल मिक्सर को फीड किया जाता है, और ऊपरी गेट पर स्थानीय थरथरानवाला सिग्नल मिक्सर को फीड किया जाता है. दोनों संकेतों को मिक्सर द्वारा गुणा किया जाता है, और अंतर आवृत्ति, मध्यवर्ती आवृत्ति, कैस्कोड मिक्सर की ऊपरी नाली से ली जाती है।

इसे संतुलित मिक्सर बनाने के लिए पूरे अंतर प्रवर्धक#लंबी-पूंछ जोड़ी|अंतर-प्रवर्धक चरणों को कैसकोडिंग द्वारा विकसित किया गया था, और फिर गिल्बर्ट सेल डबल-संतुलित मिक्सर.

अन्य अनुप्रयोग
एकीकृत परिपथों के उदय के साथ, सिलिकॉन डाई क्षेत्र के संदर्भ में ट्रांजिस्टर सस्ते हो गए हैं। विशेष रूप से एमओएसएफईटी प्रौद्योगिकी में, आउटपुट वर्तमान स्रोत के आउटपुट प्रतिबाधा को बढ़ाने के लिए वर्तमान दर्पणों में कैसकोडिंग का उपयोग किया जा सकता है।

कैस्कोड का संशोधित संस्करण भी  मॉडुलन  के रूप में उपयोग किया जा सकता है, विशेष रूप से आयाम मॉड्यूलेशन के लिए। ऊपरी डिवाइस ऑडियो सिग्नल की आपूर्ति करता है, और निचला  आरएफ न्यूनाधिक  एम्पलीफायर डिवाइस है।

उच्च-वोल्टेज ट्रांजिस्टर बनाने के लिए कैस्कोड को वोल्टेज सीढ़ी के साथ भी जोड़ा जा सकता है। इनपुट ट्रांजिस्टर किसी भी लो-यू का हो सकता हैCEO प्रकार, जबकि अन्य, स्टैक्ड रैखिक नियामक # सरल श्रृंखला नियामक वोल्टेज नियामकों के रूप में कार्य करते हुए, आपूर्ति वोल्टेज के काफी अंश का सामना करने में सक्षम होना चाहिए। ध्यान दें कि  बड़े आउटपुट-वोल्टेज स्विंग के लिए, उनके बेस वोल्टेज को कैपेसिटर द्वारा ग्राउंड पर बायपास नहीं किया जाना चाहिए, और ऊपरवाला सीढ़ी रोकनेवाला पूर्ण आपूर्ति वोल्टेज का सामना करने में सक्षम होना चाहिए। इससे पता चलता है कि रैखिक श्रृंखला वोल्टेज नियामक वास्तव में  वर्तमान बफर है जिसके  इनपुट  और  आउटपुट  पदनामों की अदला-बदली होती है।

दो-पोर्ट पैरामीटर
कैस्कोड कॉन्फ़िगरेशन को इसके इनपुट प्रतिबाधा, आउटपुट प्रतिबाधा और वोल्टेज लाभ (इलेक्ट्रॉनिक्स) का उपयोग करके साधारण वोल्टेज एम्पलीफायर (या अधिक सटीक रूप से, जी-पैरामीटर दो-पोर्ट नेटवर्क के रूप में) के रूप में दर्शाया जा सकता है। ये पैरामीटर नीचे दिए गए संबंधित जी-पैरामीटर से संबंधित हैं। अन्य उपयोगी गुणों पर यहां विचार नहीं किया गया है सर्किट बैंडविड्थ (सिग्नल प्रोसेसिंग) और डायनेमिक रेंज#इलेक्ट्रॉनिक्स।

BJT कैस्कोड: कम-आवृत्ति वाले छोटे-सिग्नल पैरामीटर
चित्र 2 में सर्किट के लिए आदर्श छोटे-सिग्नल समतुल्य सर्किट का निर्माण खुले सर्किट के साथ वर्तमान स्रोतों और शॉर्ट सर्किट वाले कैपेसिटर को बदलकर किया जा सकता है, यह मानते हुए कि वे ब्याज की आवृत्तियों पर शॉर्ट सर्किट के रूप में कार्य करने के लिए पर्याप्त हैं। बीजेटी को छोटे-सिग्नल सर्किट में हाइब्रिड-पी मॉडल|हाइब्रिड-π मॉडल द्वारा दर्शाया जा सकता है।

MOSFET कैस्कोड: कम-आवृत्ति वाले छोटे-सिग्नल पैरामीटर
इसी तरह, एमओएसएफईटी संस्करण के लिए छोटे-संकेत पैरामीटर प्राप्त किए जा सकते हैं, एमओएसएफईटी को इसके हाइब्रिड-π मॉडल समकक्ष द्वारा भी प्रतिस्थापित किया जा सकता है। इस व्युत्पत्ति को यह देखते हुए सरल किया जा सकता है कि MOSFET गेट करंट शून्य है, इसलिए BJT के लिए छोटा-सिग्नल मॉडल शून्य बेस करंट की सीमा में MOSFET का बन जाता है:
 * $$I_B \to 0 \rArr r_\pi = \frac{V_T}{I_B} \to \infty,$$

जहां वीTबोल्ट्जमान स्थिरांक है # सेमीकंडक्टर भौतिकी में भूमिका: थर्मल वोल्टेज।

कारकों का संयोजन जीmrOउपरोक्त सूत्रों में अक्सर होता है, जो आगे की परीक्षा को आमंत्रित करता है। द्विध्रुवी ट्रांजिस्टर के लिए यह उत्पाद है ( हाइब्रिड-पाई मॉडल देखें):


 * $$g_m r_O = \frac{I_C}{V_T} \frac{V_A + V_{CE}}{I_C} = \frac{V_A + V_{CE}}{V_T}.$$

विशिष्ट असतत द्विध्रुवी उपकरण में अर्ली वोल्टेज VA≈ 100 वी और कमरे के तापमान के पास थर्मल वोल्टेज वी हैT≈ 25 mV, जिससे g बनता हैmrO≈ 4000, एक बड़ी संख्या।

हाइब्रिड-पीआई मॉडल पर लेख से, हम MOSFET को सक्रिय मोड में पाते हैं:


 * $$g_m r_O = \frac{2I_D}{V_{GS} - V_{th}} \frac{1/\lambda + V_{DS}}{I_D} = \frac{2(1/\lambda + V_{DS})}{V_{GS} - V_{th}}.$$

65 नैनोमीटर प्रौद्योगिकी नोड पर, ID≈ 1.2 mA/μ चौड़ाई, आपूर्ति वोल्टेज V हैDD= 1.1 वी; मेंth≈ 165 एमवी, और वीov = वीGS-मेंth ≈ 5% वीDD≈ 55 एमवी। सामान्य लंबाई को न्यूनतम दो बार लेते हुए, L = 2 Lmin= 0.130 सुक्ष्ममापी और λ ≈ 1/(4 V/μm L) का विशिष्ट मान, हम 1/λ ≈ 2 V, और g पाते हैंmrO≈ 110, फिर भी बड़ा मान।  बात यह है कि क्योंकि जीmrOप्रौद्योगिकी की परवाह किए बिना लगभग बड़ा है, MOSFET और द्विध्रुवी कैस्कोड दोनों के लिए सारणीबद्ध लाभ और आउटपुट प्रतिरोध बहुत बड़ा है। इस तथ्य का आगामी चर्चा में निहितार्थ है।

कम आवृत्ति डिजाइन
उपरोक्त फ़ार्मुलों में पाए जाने वाले जी-पैरामीटर का उपयोग मूल कैस्कोड (समतुल्य सर्किट) के समान लाभ, इनपुट और आउटपुट प्रतिरोध के साथ छोटे-सिग्नल वोल्टेज एम्पलीफायर के निर्माण के लिए किया जा सकता है। यह सर्किट केवल इतनी कम आवृत्तियों पर लागू होता है कि ट्रांजिस्टर परजीवी समाई कोई मायने नहीं रखती। यह आंकड़ा मूल कैस्कोड (चित्र 1) और समतुल्य वोल्टेज एम्पलीफायर या जी-समतुल्य दो-पोर्ट (चित्र 4) दिखाता है। समतुल्य सर्किट विभिन्न चालकों और भारों के लिए सर्किट के व्यवहार की आसान गणना की अनुमति देता है। चित्र में थेवेनिन प्रतिरोध आर के साथ थेवेनिन समकक्ष वोल्टेज स्रोतSएम्पलीफायर ड्राइव करता है, और आउटपुट पर  साधारण लोड रेसिस्टर आरLसंलग्न है। समतुल्य सर्किट का उपयोग करते हुए, एम्पलीफायर के लिए इनपुट वोल्टेज है ( वोल्टेज विभक्त  देखें):
 * $${\upsilon}_{in} = {\upsilon}_s \begin{matrix} \frac {R_{in}}{R_S + R_{in}} \end{matrix}$$,

जो R प्रतिरोध वाले ड्राइवर के उपयोग के महत्व को दर्शाता हैS << आरinएम्पलीफायर में प्रवेश करने वाले सिग्नल के क्षीणन से बचने के लिए। उपरोक्त प्रवर्धक विशेषताओं से, हम देखते हैं कि आरinMOSFET कैस्कोड के लिए अनंत है, इसलिए उस स्थिति में इनपुट सिग्नल का कोई क्षीणन नहीं होता है। BJT कैस्कोड अधिक प्रतिबंधात्मक है क्योंकि Rin = आरπ2.

इसी तरह, समतुल्य सर्किट से आउटपुट सिग्नल है
 * $${\upsilon}_{out} = A_v \ {\upsilon}_{in} \begin{matrix} \frac {R_{L}}{R_L + R_{out}} \end{matrix}$$.

कम-आवृत्ति सर्किट में, उच्च वोल्टेज लाभ आमतौर पर वांछित होता है, इसलिए प्रतिरोध आर के साथ लोड का उपयोग करने का महत्वL >> आरoutलोड तक पहुँचने वाले सिग्नल के क्षीणन से बचने के लिए। आर के लिए सूत्रoutलोड की तुलना में पर्याप्त रूप से छोटे आउटपुट प्रतिरोध के साथ  एम्पलीफायर को डिजाइन करने के लिए इस्तेमाल किया जा सकता है या, यदि ऐसा नहीं किया जा सकता है, तो  संशोधित सर्किट पर निर्णय लेने के लिए, उदाहरण के लिए,  वोल्टेज अनुयायी जोड़ने के लिए जो लोड से बेहतर मेल खाता है।

पहले के अनुमान से पता चला है कि कैस्कोड आउटपुट प्रतिरोध बहुत बड़ा है। निहितार्थ यह है कि कई लोड प्रतिरोध शर्त आर को संतुष्ट नहीं करेंगेL >> आरout( महत्वपूर्ण अपवाद MOSFET को लोड के रूप में चला रहा है, जिसमें अनंत कम आवृत्ति इनपुट प्रतिबाधा है)। हालाँकि, शर्त को पूरा करने में विफलता RL >> आरoutआपदाजनक नहीं है क्योंकि कैस्कोड लाभ भी बहुत बड़ा है। यदि डिजाइनर तैयार है, तो कम भार प्रतिरोध की अनुमति देने के लिए बड़े लाभ का त्याग किया जा सकता है; आर के लिएL<< आरoutलाभ निम्नानुसार सरल होता है:
 * $${\upsilon}_{out} = A_v \ {\upsilon}_{in} \begin{matrix} \frac {R_{L}}{R_L + R_{out}} \approx A_v \ {\upsilon}_{in} \frac {R_{L}}{R_{out}} = \frac {A_v }{R_{out}}\ {\upsilon}_{in} R_L \approx -g_{m2} R_L {\upsilon}_{in}\end{matrix}$$.

यह लाभ उतना ही है जितना अकेले अभिनय करने वाले इनपुट ट्रांजिस्टर के लिए। इस प्रकार, यहां तक ​​कि लाभ का त्याग करते हुए, कैस्कोड एकल-ट्रांजिस्टर ट्रांसकंडक्शन एम्पलीफायर के समान लाभ पैदा करता है, लेकिन व्यापक बैंडविड्थ के साथ।

चूंकि एम्पलीफायर व्यापक बैंडविड्थ हैं, वही दृष्टिकोण सर्किट की बैंडविड्थ निर्धारित कर सकता है जब भार संधारित्र  संलग्न होता है (बिना या बिना) load resistor). आवश्यक धारणा यह है कि  भार समाई  काफी बड़ा है कि यह आवृत्ति निर्भरता को नियंत्रित करता है, और बैंडविड्थ स्वयं ट्रांजिस्टर के उपेक्षित परजीवी कैपेसिटेंस द्वारा नियंत्रित नहीं होता है।

उच्च आवृत्ति डिजाइन
उच्च आवृत्तियों पर, सटीक आवृत्ति प्रतिक्रिया प्राप्त करने के लिए ट्रांजिस्टर (गेट-टू-ड्रेन, गेट-टू-सोर्स, ड्रेन-टू बॉडी, और बाइपोलर समतुल्य) के परजीवी समाई को हाइब्रिड-π मॉडल में शामिल किया जाना चाहिए। कम आवृत्ति वाले डिज़ाइन के लिए ऊपर वर्णित समग्र उच्च लाभ पर जोर देने से डिज़ाइन लक्ष्य भी भिन्न होते हैं। उच्च आवृत्ति सर्किट में, सिग्नल प्रतिबिंबों को खत्म करने और शक्ति लाभ को अधिकतम करने के लिए एम्पलीफायर के इनपुट और आउटपुट पर प्रतिबाधा मिलान आमतौर पर वांछित होता है। कैस्कोड में, इनपुट और आउटपुट बंदरगाह (सर्किट सिद्धांत)  के बीच अलगाव अभी भी  छोटे से रिवर्स ट्रांसमिशन टर्म जी द्वारा विशेषता है12, मेल खाने वाले नेटवर्क को डिजाइन करना आसान बनाता है क्योंकि एम्पलीफायर लगभग एकतरफा है।